基于ARM和FPGA的聲納波形產(chǎn)生系統(tǒng)設(shè)
1、引言
本文引用地址:http://butianyuan.cn/article/152568.htm最佳聲納系統(tǒng)的設(shè)計需要從聲納波形、聲納信道和聲納接收機三方面進行綜合考慮[1]。在聲納信道一定的假設(shè)下,需要設(shè)計最佳聲納波形和最佳接收機,使聲納系統(tǒng)能在給定的聲納環(huán)境中對目標(biāo)有最佳的檢測效果。工作在淺水中的主動聲納,其性能主要受限于混響級。根據(jù)波形選擇與信道匹配的原則,針對混響信道,所選的聲納波形應(yīng)使其模糊度函數(shù)盡量與混響信道散射函數(shù)不重合,而與聲傳輸信號散射函數(shù)盡量重合[2]。基于這樣的原則,常用的聲納信號單頻信號(CW)、線性調(diào)頻信號(LFM)抑制混響的能力比較如下:在檢測靜止或低速目標(biāo)時,LFM和短CW較長CW有更好的混響抑制能力,但短CW波只適合近距離目標(biāo);在檢測高速運動目標(biāo)時,長CW脈沖是最合適的信號形式[2]。由此可見,主動聲納要完成目標(biāo)捕獲、識別、跟蹤等不同任務(wù),需要發(fā)射不同的聲納波形。同時針對遠(yuǎn)距離、低速和高速運動等目標(biāo)的不同情況,也需要靈活的選擇聲納波形。正是基于這樣一種需求,本文把具有強大控制能力的微處理器ARM與具有靈活波形產(chǎn)生能力的直接數(shù)字頻率合成技術(shù)(DDS)結(jié)合起來,用FPGA實現(xiàn)DDS技術(shù),設(shè)計出了基于ARM和FPGA的聲納波形產(chǎn)生系統(tǒng)。
2、DDS基本原理
隨著微電子技術(shù)的迅速發(fā)展,具有頻率切換時間短、頻率分辨率高、相位變化連續(xù)、易實現(xiàn)信號的多種調(diào)制等諸多優(yōu)點的DDS技術(shù),有了廣闊的應(yīng)用前景。DDS技術(shù)可以理解為數(shù)字信號處理中信號綜合的硬件實現(xiàn)問題,即給定信號幅度、頻率、相位等參數(shù),產(chǎn)生所需要的信號波形。
DDS的基本結(jié)構(gòu)包括:相位累加器、相位-幅值轉(zhuǎn)換電路、數(shù)模轉(zhuǎn)換電路及低通濾波器等。相位-幅值轉(zhuǎn)換電路根據(jù)轉(zhuǎn)換方式的不同可分為兩大類[4]:(1)ROM查找表法。ROM中存儲有不同相位對應(yīng)的幅度值,可根據(jù)相位累加器輸出的相位值尋址ROM,輸出對應(yīng)的幅值序列。 (2)計算法。對相位累加器輸出的相位值,通過數(shù)學(xué)計算的方法得到對應(yīng)的幅值。常用的實時計算方法有泰勒級數(shù)求值法、反函數(shù)求值法、CORDIC算法等。
相位累加器是DDS電路中核心的模塊,在工程實踐上一般用數(shù)字全加器和數(shù)字寄存器的組合來實現(xiàn),是一個典型的反饋電路。如圖1所示。
其中, 為頻率控制字, 為相位累加器的位數(shù),fclk為系統(tǒng)參考時鐘。相位累加器的工作過程為:每來一個參考時鐘脈沖,頻率控制字 與相位寄存器輸出的相位數(shù)據(jù)累加一次,累加后的相位一方面反饋到全加器的輸入端,以使全加器在下一時鐘的作用下繼續(xù)與頻率控制字 相加;另一方面作為采樣地址值送入ROM查找表。如此循環(huán),當(dāng)相位累加器累加滿量后,就會產(chǎn)生一次溢出,ROM存儲器的地址正好循環(huán)一次,完成一個周期性的動作,這個周期就是DDS合成信號的周期,累加器的溢出頻率就是合成信號的頻率[8]。圖2為相位累加過程示意圖及對應(yīng)輸出的占空比1:1的CW波。
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