基于3GHz CMOS低噪聲放大器優(yōu)化設(shè)計

　摘要： 基于0.18 μm CMOS工藝，采用共源共柵源極負反饋結(jié)構(gòu)，設(shè)計了一種3 GHz低噪聲放大器電路。從阻抗匹配及噪聲優(yōu)化的角度分析了電路的性能，提出了相應(yīng)的優(yōu)化設(shè)計方法。仿真結(jié)果表明，該放大器具有良好的性能指標(biāo)，功率增益為23.4 dB，反向傳輸系數(shù)為-25.9 dB，噪聲系數(shù)為1.1 dB，1dB壓縮點為13.05 dBm。
　1 引 言

　　現(xiàn)代無線通信技術(shù)不斷地朝著低成本、便攜式的方向發(fā)展，使得基于CMOS工藝的射頻集成電路成為近年來的研究熱點。在射頻接收機的設(shè)計中，要想得到良好的總體系統(tǒng)性能，前端電路的優(yōu)化設(shè)計尤為關(guān)鍵。而低噪聲放大器（LNA）作為無線通信系統(tǒng)射頻接收機的第一個功能模塊，其噪聲特性直接影響著整個接收機的靈敏度和信噪比，它必須在一定的功耗條件下，提供足夠的增益、優(yōu)異的噪聲性能、良好的線性度和輸入輸出匹配。在GHz頻率范圍內(nèi)，CMOS工藝相比其他工藝有價格低、集成度高、功耗低等優(yōu)點，利用CMOS工藝來設(shè)計射頻集成電路已經(jīng)得到越來越廣泛的應(yīng)用，本文即采用CMOS工藝來實現(xiàn)對一種3 GHz低噪聲放大器的優(yōu)化設(shè)計。

　　在LNA的設(shè)計中，應(yīng)對增益、噪聲系數(shù)、輸入阻抗、線性度等幾個關(guān)鍵參數(shù)采取折衷原則進行處理[1]。T. H. Lee提出了功率約束條件下的設(shè)計規(guī)范[2]，之后又有很多人對CMOS LNA的設(shè)計方法進行了研究[3-5]。本文主要從分析LNA的輸入輸出阻抗匹配和噪聲系數(shù)的角度出發(fā)，針對每個參數(shù)的影響因素，分別提出優(yōu)化的方法，然后綜合考慮其他各項指標(biāo)，設(shè)計出了一種性能良好的低噪聲放大器，并進行了電路仿真和版圖設(shè)計。

　　2 LNA結(jié)構(gòu)

　　在LNA的設(shè)計中，目前廣泛采用的是共源共柵源極負反饋（Cascode）結(jié)構(gòu)，如圖1所示。在此結(jié)構(gòu)中，源極負反饋既能實現(xiàn)輸入阻抗匹配，又能提高系統(tǒng)的穩(wěn)定性，且具有改善LNA線性度的特點，而M1和M2組成的級聯(lián)結(jié)構(gòu)，既提高了電路的輸出阻抗，使電路的增益有較大的提高，又能實現(xiàn)對電路的反向隔離[6]，使得輸出端和輸入端互不影響，從而方便了LNA的設(shè)計。

圖1 共源共柵源極負反饋結(jié)構(gòu)