基于CORDIC算法2FSK調(diào)制器的FPGA設(shè)計(jì)
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時(shí)間：2011-05-30
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為了避免復(fù)雜的乘法運(yùn)算，用一系列微旋轉(zhuǎn)來(lái)處理，第i次旋轉(zhuǎn)可表示為：
式中：θi表示第i次旋轉(zhuǎn)的角度，并且滿(mǎn)足tanθi=2-i；zi表示第i次旋轉(zhuǎn)后與目標(biāo)角度的差；δi表示向量的旋轉(zhuǎn)方向，由zi的符號(hào)位來(lái)決定，即δi=sign zi。
為每一級(jí)的校正因子，也就是每一級(jí)旋轉(zhuǎn)時(shí)向量模長(zhǎng)發(fā)生的變化，對(duì)于字長(zhǎng)一定的運(yùn)算，總的校正因子是一個(gè)常數(shù)。若總的旋轉(zhuǎn)次數(shù)為n，則總校正因子用k表示為：
由式(7)可知：xn，yn分別為輸入角θ的余弦和正弦值，故基于CORDIC算法可產(chǎn)生正弦載波信號(hào)，而且由式(5)可以看出所有運(yùn)算簡(jiǎn)化成加減法和移位操作，因此很容易用硬件實(shí)現(xiàn)。本文引用地址：http://butianyuan.cn/article/191186.htm
1．2 CORDIC流水線(xiàn)結(jié)構(gòu)
CORDIC算法的實(shí)現(xiàn)方式有2種：簡(jiǎn)單狀態(tài)機(jī)法和高速全流水線(xiàn)處理器法。如果計(jì)算時(shí)間的要求不嚴(yán)格，可以采用狀態(tài)機(jī)結(jié)構(gòu)。這一結(jié)構(gòu)中最復(fù)雜的就是兩個(gè)桶狀移位器，而桶狀移位器的面積大約和它所包含的傳輸門(mén)的數(shù)目成正比。盡管可以通過(guò)改進(jìn)CORDIC算法來(lái)減小CORDIC處理器的總面積，但桶狀移位器所占的面積并不能減小。另外，這種結(jié)構(gòu)由于只在時(shí)間上復(fù)用資源，因此，數(shù)據(jù)吞吐率不高。
評(píng)論