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基于FPGA的IDE硬盤(pán)數(shù)據(jù)AES加解密研究與實(shí)現(xiàn)

作者：時(shí)間：2017-06-05 來(lái)源：網(wǎng)絡(luò)

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提出了基于FPGA對(duì)IDE硬盤(pán)數(shù)據(jù)進(jìn)行AES加解密的方法。對(duì)算法進(jìn)行了改進(jìn)和優(yōu)化，以降低加解密過(guò)程對(duì)IDE硬盤(pán)數(shù)據(jù)傳輸速度的影響。

基于FPGA的IDE硬盤(pán)數(shù)據(jù)AES加解密研究與實(shí)現(xiàn).pdf

本文引用地址：http://www.butianyuan.cn/article/201706/349271.htm

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關(guān)鍵詞： AES加解密 IDE FPGA

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