盤點RS485收發(fā)連接器參考電路設(shè)計

555定時器為邊沿觸發(fā)，當(dāng)TxD發(fā)送高電平時，555定時器OUT引腳輸出低電平，當(dāng)TxD發(fā)送低電平時，555定時器OUT引腳輸出高電平，當(dāng)TxD轉(zhuǎn)為高電平時，OUT引腳輸出的高電平狀態(tài)會延遲一會再轉(zhuǎn)入低電平，以確保發(fā)送數(shù)據(jù)的正確性。

采用74HC14和RC電路實現(xiàn)，此電路是對單純使用74HC14實現(xiàn)自收發(fā)電路的改進，增加了RC充放電電路，減少總線處于空閑狀態(tài)的時間，電路如下圖：

當(dāng)TxD信號為高電平，則通過電阻為電容充電，其充電時間為T，該時間應(yīng)設(shè)置為串口發(fā)送一個字節(jié)所需要的時間，由R，C參數(shù)來確定。當(dāng)電容充滿后，則DE／RE為低電平，使ADM2483處于接收狀態(tài)。在發(fā)送數(shù)據(jù)時，TxD起始位產(chǎn)生第一個下降沿，使電容經(jīng)過二極管進行快速放電，使DE／RE很快變?yōu)楦唠娖剑珹DM2483處于發(fā)送狀態(tài)。在發(fā)送過程中， 當(dāng)TxD變成高電平時，電容通過電阻緩慢充電，使DE／RE仍然保持在發(fā)送狀態(tài)，可有效吸收總線上的反射信號。當(dāng)RC充電結(jié)束，使DE／RE轉(zhuǎn)入接受狀態(tài)時， 總線上的上拉、下拉電阻將維持TxD高電平的發(fā)送狀態(tài)，直至整個bit發(fā)送結(jié)束。

當(dāng)數(shù)據(jù)發(fā)送完畢以后，TxD變?yōu)楦唠娖?，RC又開始充電，即經(jīng)T時間后，ADM2483又轉(zhuǎn)換為接收狀態(tài)。以上所有電路均為參考電路，為電路設(shè)計者提供思路，在實際使用中請再次驗證，以確保電路的穩(wěn)定及不會對系統(tǒng)造成破壞。對于電路損壞造成的損失，概不負責(zé)。