一種高精度、寬動(dòng)態(tài)范圍的APD偏壓控制／光功率監(jiān)測(cè)電路設(shè)計(jì)
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3．3 GARD電路
GARD電路主要用來(lái)屏蔽VAPD線路不受漏電流的影響，以及濾除偏置控制電路的噪聲。GARD電路由VSET端運(yùn)算放大器通過(guò)一個(gè)20 k歐姆的電阻進(jìn)行驅(qū)動(dòng)。該電阻與GARD端外接電容構(gòu)成RC網(wǎng)絡(luò)，用于濾除運(yùn)算放大器反饋網(wǎng)絡(luò)的熱噪聲。
GARD電路的噪聲和小信號(hào)的截止頻率定義如下：
其中：f3dB是內(nèi)部電阻20 k歐姆和外接電容CGRD構(gòu)成的低通濾波器的截止頻率；CGRD是GARD端至地的濾波電容。
CGRD的容值越大(最大約0．01μF)，ADL5317在最低輸入電流處的噪聲抑制性能越好，但是同時(shí)會(huì)延緩對(duì)VSET端電壓變換的響應(yīng)時(shí)間。
3．4 VCLH電路
高電壓箝制電路(VCLH)是用于限制APD偏置電壓不能超過(guò)VCLH端電壓。其內(nèi)部通過(guò)一只25k歐姆電阻將電位設(shè)置在相對(duì)于VPHV始終低2．0 V處，并不受溫度影響。
在線性模式下，VCLH端與VPHV端連接，可擴(kuò)展線性工作范圍(上限高達(dá)VPHV-1．5 V)。在電源跟隨模式下，VCLH端則必須置空。
3．5 過(guò)流和過(guò)溫保護(hù)電路
FALT是集電極開(kāi)路邏輯輸出端(低電平有效)，用于
評(píng)論