瞬變光輻射信號(hào)探測的數(shù)據(jù)采集系統(tǒng)

　　3.1 自適應(yīng)閾值設(shè)定

　　自適應(yīng)閾值的設(shè)定是根據(jù)當(dāng)前背景噪聲的大小進(jìn)行現(xiàn)有閾值進(jìn)行更新。系統(tǒng)默認(rèn)的工作狀態(tài)是背景檢測模式，當(dāng)采集到系統(tǒng)所要求的數(shù)據(jù)個(gè)數(shù)后，將這些數(shù)據(jù)求其有效值后乘以一個(gè)加權(quán)系數(shù)(一般情況下是5～10)作為當(dāng)前的閾值。系統(tǒng)每隔一段時(shí)間給FPGA重新賦閾值。當(dāng)所采集的數(shù)據(jù)的幅值連續(xù)超過當(dāng)前閾值設(shè)定的次數(shù)時(shí)，此時(shí)系統(tǒng)判定當(dāng)前的背景信號(hào)發(fā)生，F(xiàn)PGA控制切換相關(guān)的電路，啟動(dòng)相關(guān)的電路工作。這樣做的目的是防止高能粒子撞擊光學(xué)鏡頭或是光罩，瞬間產(chǎn)生超過當(dāng)前閾值的能量造成誤觸發(fā)。

3.2 變頻存儲(chǔ)的實(shí)現(xiàn)

　　為了減小信號(hào)處理的數(shù)據(jù)量，根據(jù)目標(biāo)信號(hào)的特征，可采用變速率存儲(chǔ)技術(shù)。盡管所探測的瞬變光輻射信號(hào)的最高頻率一般在10 kHz左右，根據(jù)奈奎斯特采樣定理，采樣頻率只要在20 kHz以上即可以無失真的還原信號(hào)，但是所要探測的光輻射信號(hào)中有一些關(guān)鍵峰值到達(dá)時(shí)刻最小不到半個(gè)毫秒，高速率采樣有助于提高計(jì)算峰值到達(dá)時(shí)刻的精度，同時(shí)有利于提高A/D的信噪比。A/D采集系統(tǒng)初始的采樣頻率為200 kHz，每隔32個(gè)采樣點(diǎn)，存儲(chǔ)頻率下降50%。

　　在電路中采用的方法是：A/D轉(zhuǎn)換器按照固定的轉(zhuǎn)換頻率進(jìn)行模擬量到數(shù)字量的轉(zhuǎn)換，通過FPGA控制數(shù)據(jù)的變速率存儲(chǔ)。其具體的VHDL設(shè)計(jì)步驟如下：

　　(1)實(shí)現(xiàn)采樣時(shí)鐘的逐次分頻;

　　(2)調(diào)整逐次分頻的占空比，以防止數(shù)據(jù)存儲(chǔ)錯(cuò)誤;

　　(3)設(shè)計(jì)使能信號(hào)，實(shí)現(xiàn)對(duì)每組只存儲(chǔ)32點(diǎn)。

　　由于系統(tǒng)對(duì)目標(biāo)信號(hào)采集時(shí)間長度是固定的，故變頻存儲(chǔ)的變頻次數(shù)是有限的。初始存儲(chǔ)時(shí)間間隔△t=0.01 ms，其變頻次數(shù)不超過16次。故本方案中設(shè)計(jì)一個(gè)16位計(jì)數(shù)器counter16，對(duì)200 kHz采樣時(shí)鐘計(jì)數(shù)。計(jì)數(shù)器counter16的第0～15位的輸出，即可以實(shí)現(xiàn)對(duì)200 kHz采樣時(shí)鐘的逐次二分頻。但是由于從counter16(1)開始，每個(gè)低位輸出時(shí)對(duì)應(yīng)著K個(gè)有效數(shù)據(jù)，但存儲(chǔ)的數(shù)據(jù)只會(huì)是最后一個(gè)有效數(shù)據(jù)，這樣可能會(huì)造成數(shù)據(jù)存儲(chǔ)出錯(cuò)，故需要對(duì)counter16(1)～counter16(15)進(jìn)行占空比調(diào)整。將占空比從1：1調(diào)整為1：(2K-1)，其中K為整數(shù)(K=2～32 768)。調(diào)整占空比VHDL的思路為設(shè)計(jì)一個(gè)16位的counter16_v計(jì)數(shù)器，將counter16的相應(yīng)位進(jìn)行相與后賦給相應(yīng)的counter16_v。

　　由于每組只存儲(chǔ)32個(gè)數(shù)據(jù)，因此對(duì)應(yīng)每組還要設(shè)計(jì)相應(yīng)的16 b使能信號(hào)dcnt。方法是對(duì)clk_200K計(jì)數(shù)，存儲(chǔ)開始后，開始64個(gè)clk_200K時(shí)鐘將第一組數(shù)據(jù)使能信號(hào)dcnt(o)置為高電平，然后保持低;接著對(duì)128個(gè)clk_200K時(shí)鐘將第二組數(shù)據(jù)使能dcnt(1)置為高電平，然后保持低。按照這種方法可將16個(gè)使能信號(hào)從dcnt(0)～dent(15)設(shè)置好。變頻存儲(chǔ)的使能頻率為ad_clk。