FPGA基礎(chǔ)入門
什么是軟核?
IP軟核通常是用 HDL文本形式提交給用戶,它經(jīng)過RTL級設(shè)計(jì)優(yōu)化和功能驗(yàn)證,但其中不含有任何具體的物理信息。據(jù)此,用戶可以綜合出正確的門電路級設(shè)計(jì)網(wǎng)表,并可以進(jìn) 行后續(xù)的結(jié)構(gòu)設(shè)計(jì),具有很大的靈活性,借助于EDA綜合工具可以很容易地與其他外部邏輯電路合成一體,根據(jù)各種不同半導(dǎo)體工藝,設(shè)計(jì)成具有不同性能的器 件。軟IP內(nèi)核也稱為虛擬組件(VC-Virtual Component)。
什么是硬核?
IP硬核是基于半導(dǎo)體工藝的物理設(shè)計(jì),已有固定的拓?fù)洳季趾途唧w工藝,并已經(jīng)過工藝驗(yàn)證,具有可保證的性能。其提供給用戶的形式是電路物理結(jié)構(gòu)掩模版圖和全套工藝文件,是可以拿來就用的全套技術(shù)。
什么是固核?
IP固核的設(shè)計(jì)程度則是介于軟核和硬核之間,除了完成軟核所有的設(shè)計(jì)外,還完成了門級電路綜合和時序仿真等設(shè)計(jì)環(huán)節(jié)。一般以門級電路網(wǎng)表的形式提供給用戶。
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