基于DSP/FPGA的超高速跳頻系統(tǒng)基帶設計

　　最上方信號是發(fā)射端跳頻序列的波形；中間信號是接收端跳頻序列的波形；最下方是幀同步信號。當識別到巴克碼時，幀同步信號出現(xiàn)一負脈沖，完成接收端調頻序列發(fā)生器反饋系數(shù)和初始相位的加載。從圖9中可知：(1)接收端跳頻序列與發(fā)射端跳頻序列變化規(guī)律一致，跳頻圖案同步成功；(2)最小碼距滿足要求，通過對偶頻帶法得到寬間隔跳頻序列成功。

　　本文對跳頻通信技術及基帶各關鍵模塊進行了深入探討和分析，給出了高速跳頻通信系統(tǒng)的系統(tǒng)設計，并通過軟件無線電技術對其進行實現(xiàn)。

　　系統(tǒng)以TI公司DSP為中心控制單元，Altera公司的FPGA為硬件邏輯平臺，AD公司的DDS為頻率合成器，采用2FSK調制解調方式，超前滯后支路的位同步方式，TOD跳頻圖案同步方式，以m序列作為跳頻序列，輔助對偶跳頻間隔控制手段，實現(xiàn)了高速、寬間隔跳頻通信系統(tǒng)。系統(tǒng)達到40kbps的跳頻速度，1 024個跳頻頻道，108M～189.84MHz的跳頻帶寬，400kHz的最小跳頻間隔，小于0.5s的入網時間以及小于30s的同步最大時差。

　　本高速跳頻通信系統(tǒng)與同類系統(tǒng)相比最大的優(yōu)勢體現(xiàn)在它40kbps的超高速跳頻速率和近百兆的跳頻帶寬上。通過與國內外類似系統(tǒng)進行比較，40kbps的跳頻速率處于技術領先位置。各關鍵模塊性能優(yōu)良，接口一致且工作穩(wěn)定，可以靈活組合成多種數(shù)字通信系統(tǒng)的基帶部分。相信本文對今后數(shù)字通信系統(tǒng)基帶部分的研究和實現(xiàn)具有很強的借鑒意義。

　　參考文獻

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