基于FPGA的存儲(chǔ)測(cè)試系統(tǒng)

　　3 實(shí)驗(yàn)驗(yàn)證

　　該實(shí)驗(yàn)對(duì)標(biāo)準(zhǔn)信號(hào)發(fā)生器輸出的正弦波信號(hào)進(jìn)行采集和存儲(chǔ)，采樣策略選擇為三環(huán)境采樣，1環(huán)境采樣頻率為1 MHz，2環(huán)境為100 kHz，3環(huán)境為50 kHz，外觸發(fā)進(jìn)入1環(huán)境，計(jì)數(shù)觸發(fā)進(jìn)入2環(huán)境，計(jì)數(shù)值128 kW，計(jì)數(shù)觸發(fā)進(jìn)入3環(huán)境，計(jì)數(shù)值32 kW。系統(tǒng)采樣完畢后，連接到計(jì)算機(jī)通過(guò)上位機(jī)軟件讀取數(shù)據(jù)，實(shí)驗(yàn)波形如圖4。

　　設(shè)置為計(jì)數(shù)128 kW進(jìn)入2環(huán)境，計(jì)數(shù)32 kW進(jìn)入3環(huán)境，而系統(tǒng)負(fù)延遲為8 kW，分為4個(gè)通道，因此1、2環(huán)境的分界點(diǎn)為(128+8)·1024／4=34816點(diǎn)，2、3環(huán)境的分界點(diǎn)為(128+8+32)*1024／4=43008點(diǎn)，實(shí)驗(yàn)波形與計(jì)算值相符。如表1所示：

　　通過(guò)上表可以看出，系統(tǒng)變頻采樣模塊的設(shè)計(jì)滿足系統(tǒng)的要求，并且系統(tǒng)是完全按照設(shè)定的采樣策略進(jìn)行采樣的。

　　4 結(jié)束語(yǔ)

　　介紹了一種用FPGA實(shí)現(xiàn)的動(dòng)態(tài)測(cè)試存儲(chǔ)測(cè)試系統(tǒng)。通過(guò)實(shí)驗(yàn)驗(yàn)證，表明系統(tǒng)能對(duì)信號(hào)進(jìn)行不失真采樣存儲(chǔ)。證實(shí)了所設(shè)計(jì)的采樣策略對(duì)多種變化規(guī)律的信號(hào)采集具有通用性，實(shí)現(xiàn)了對(duì)信號(hào)的變頻采樣，擴(kuò)展了系統(tǒng)的應(yīng)用范圍。