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垂直供電助力尖端數(shù)據(jù)處理

• 隨著先進(jìn)工藝節(jié)點(diǎn)的出現(xiàn)，高性能人工智能 (AI) 處理器的功率不斷上升，內(nèi)核電壓則在不斷下降。這些發(fā)展給電源系統(tǒng)設(shè)計(jì)人員帶來很大挑戰(zhàn)，例如需要管理因?yàn)楣╇娋W(wǎng)絡(luò) (PDN) 阻抗壓降不斷上升的而引起大電流低電壓處理器電源引腳間的電壓梯度、瞬態(tài)性能規(guī)格以及功耗等難題。 圖 1：晶體管幾何尺寸及核心電壓的降低導(dǎo)致電流需求急劇上升。以集群計(jì)算為例，緊密排列的處理器陣列可提高機(jī)器學(xué)習(xí)的速度和性能。PDN 的復(fù)雜性顯著增加，因?yàn)殡娏鱾鬏敱仨殢年嚵械南路酱怪边M(jìn)行。設(shè)計(jì) PDN 時(shí)在負(fù)載點(diǎn)使用 Vicor 分比
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