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EEPW首頁 >> 主題列表 >> 多項式擬合

多項式擬合在log-add算法單元中的應用及其FPGA實現

  • 綜合考慮面積和速度等因素，采用一次多項式擬合實現了簡單快速的log-add算法單元。實驗結果表明，在相同的精度要求下，其FPGA實現資源占用合理，硬件開銷好于其他次數的多項式擬合實現方案。
  • 關鍵字： log-add算法單元  多項式擬合  FPGA  
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多項式擬合介紹

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