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EEPW首頁 >> 主題列表 >> 密碼算法

基于FPGA的稅控算法加密卡設(shè)計(jì)與實(shí)現(xiàn)

  • 由于當(dāng)前國稅、地稅、各省、各稅種發(fā)票不同,辨別難度較大,因此給造假者可乘之機(jī)。本文設(shè)計(jì)的基于FPGA的稅控算法加密卡可有效地解決上述問題,提供了高效的防偽措施。該加密卡通過PCI總線內(nèi)置于稅控加密機(jī)中,將發(fā)
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密碼算法在智能卡中的應(yīng)用發(fā)展

  • 在過去的十年中,智能卡上的計(jì)算能力發(fā)展迅速,基于公鑰的智能卡廣泛應(yīng)用于各個(gè)領(lǐng)域。2001年Borst總結(jié)了智...
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一種AES密碼算法的硬件實(shí)現(xiàn)

  • 介紹了一種適用于較小面積應(yīng)用場合AES密碼算法的實(shí)現(xiàn)方案。結(jié)合該算法的特點(diǎn),在常規(guī)輪變換中提出一種加/解密列混合變換集成化的硬件結(jié)構(gòu)設(shè)計(jì),通過選擇使用同一個(gè)模塊,可以實(shí)現(xiàn)加密和解密中的線性變換,既整合了部分加/解密硬件結(jié)構(gòu),又節(jié)約了大量的硬件資源。仿真與綜合結(jié)果表明,加/解密運(yùn)算模塊面積不超過25 000個(gè)等效門,有效地減小了硬件實(shí)現(xiàn)面積,同時(shí)該設(shè)計(jì)方案也滿足實(shí)際應(yīng)用性能的需求。
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安全芯片中密碼算法的多IP核集成方法

  • 信息社會(huì)中,基于密碼算法設(shè)計(jì)的安全芯片,能夠?yàn)橛脩舻拿舾行畔⑻峁┯行У臋C(jī)密性與完整性保護(hù)。信息化的不斷深入使得人們對(duì)信息安全服務(wù)的需求呈現(xiàn)使用簡單化、功能多樣化、高度集成化等趨勢(shì)。這要求安全芯片在
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密碼算法介紹

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