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EEPW首頁 >> 主題列表 >> 帶隙基準電壓源

一種降低失調(diào)影響的低噪聲帶隙基準電路

  • 　　張?哲，余先銀，張啟輝（電子科技大學?電子科學與工程學院，成都?611731）　　摘?要：基于經(jīng)典的帶隙基準電路原理，通過優(yōu)化電路結(jié)構(gòu)和采用寄生NPN晶體管，提出了一種可以降低運放失調(diào)電壓和等效輸入噪聲影響的低噪聲帶隙基準電路。利用運放鉗位流過晶體管的電流的比例，降低了運放失調(diào)電壓和等效輸入噪聲至帶隙輸出電壓的增益，實現(xiàn)了更穩(wěn)定的基準電壓輸出。電路設(shè)計采用GSMC 0.18 μm工藝，經(jīng)過Hspice仿真驗證，在2.5 V電源電壓下，基準輸出電壓為1.2 V；在（-40~125）℃溫度范圍內(nèi)，基準電壓
  • 關(guān)鍵字： 201910  帶隙基準電壓源  降低運放失調(diào)電壓影響  低噪聲  

一種高精度帶隙基準電壓源電路設(shè)計

  • 摘要：針對傳統(tǒng)CMOS帶隙電壓基準源電路電源電壓較高，基準電壓輸出范圍有限等問題，通過增加啟動電路，并采用共源共柵結(jié)構(gòu)的PTAT電流產(chǎn)生電路，設(shè)計了一種高精度、低溫漂、與電源無關(guān)的具有穩(wěn)定電壓輸出特性的帶隙電
  • 關(guān)鍵字： 帶隙基準電壓源  溫度系數(shù)  共源共柵  CMOS  

應(yīng)用模擬微控制器簡化數(shù)據(jù)采集系統(tǒng)設(shè)計

共3條 1/1 1

帶隙基準電壓源介紹

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