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EEPW首頁 >> 主題列表 >> 改進(jìn)的bm算法

基于FPGA的RS碼譯碼器的設(shè)計(jì)

  • 摘要：介紹了符合CCSDS標(biāo)準(zhǔn)的RS(255，223)碼譯碼器的硬件實(shí)現(xiàn)結(jié)構(gòu)。譯碼器采用8位并行時(shí)域譯碼算法，主要包括了修正后的無逆BM迭代譯碼算法，錢搜索算法和Forney算法。采用了三級(jí)流水線結(jié)構(gòu)實(shí)現(xiàn)，減小了譯碼器的時(shí)延
  • 關(guān)鍵字： RS碼  FPGA  譯碼器  有限域  改進(jìn)的BM算法  
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改進(jìn)的bm算法介紹

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