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EEPW首頁 >> 主題列表 >> 數(shù)字密碼鎖

FPGA實(shí)現(xiàn)的數(shù)字密碼鎖

  •   本文介紹了一種以FPGA為基礎(chǔ)的數(shù)字密碼鎖。采用自頂向下的數(shù)字系統(tǒng)設(shè)計(jì)方法,將數(shù)字密碼鎖系統(tǒng)分解為若干子系統(tǒng),并且進(jìn)一步細(xì)劃為若干模塊,然后用硬件描述語言VHDL來設(shè)計(jì)這些模塊,同時(shí)進(jìn)行硬件測試。測試結(jié)果表明該數(shù)字密碼鎖能夠校驗(yàn)10位十進(jìn)制數(shù)字密碼,且可以預(yù)置密碼,設(shè)有斷電保護(hù)裝置,解碼有效指示等相應(yīng)功能。   1功能概述   (1)密碼鎖的工作時(shí)鐘由外部晶振提供,時(shí)鐘頻率為50MHz,運(yùn)算速度高,工作性能穩(wěn)定。   (2)密碼的設(shè)置和輸入由外接鍵盤完成,控制電路的安全系數(shù)高,操作方便;   
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基于FGPA的數(shù)字密碼鎖

  • 摘要:采用VHDL硬件描述語言,以自頂向下的設(shè)計(jì)方法,在Quartus II 9.1的開發(fā)環(huán)境下,設(shè)計(jì)了基于FPGA的數(shù)字密碼鎖。并選用ALTERA公司Cylone II系列的EP2C35F672C8芯片為其硬件條件,驗(yàn)證了其功能及可靠性。結(jié)果表明
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數(shù)字密碼鎖介紹

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