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EEPW首頁(yè) >> 主題列表 >> 數(shù)字脈沖

基于FPGA的數(shù)字脈沖壓縮系統(tǒng)實(shí)現(xiàn)

  • 針對(duì)采用線性調(diào)頻信號(hào)的寬帶雷達(dá)系統(tǒng)，完成單通道高速數(shù)據(jù)采集和數(shù)字脈沖壓縮系統(tǒng)的工程實(shí)現(xiàn)。系統(tǒng)使用ADS5500完成14位、60 MSPS的數(shù)據(jù)采集，使用FPGA實(shí)現(xiàn)1 024點(diǎn)的數(shù)字脈沖壓縮。脈沖壓縮模塊采用快速傅里葉變換IP核進(jìn)行設(shè)計(jì)，可以在脈沖壓縮的不同階段對(duì)其進(jìn)行復(fù)用，分別完成FFT和IFFT運(yùn)算，從而使硬件規(guī)模大大減少。系統(tǒng)采用塊浮點(diǎn)數(shù)據(jù)格式以提高動(dòng)態(tài)范圍，同時(shí)減小截?cái)?或舍入)誤差對(duì)輸出信噪比的影響。
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數(shù)字脈沖壓縮技術(shù)在雷達(dá)中的應(yīng)用

  • 引 言
    隨著現(xiàn)代技術(shù)的發(fā)展，對(duì)雷達(dá)的作用距離、分辨率和測(cè)量精度等性能指標(biāo)提出了越來越高的要求。為了增加雷達(dá)系統(tǒng)的檢測(cè)能力，要求增大雷達(dá)發(fā)射的平均功率。在峰值功率受限時(shí)，要求發(fā)射脈沖盡量寬，而為了提
  • 關(guān)鍵字： 數(shù)字脈沖  雷達(dá)  壓縮技術(shù)  中的應(yīng)用    
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數(shù)字脈沖介紹

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