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基于ASIC的功耗評(píng)估與優(yōu)化設(shè)計(jì)

  • Power estimation and optimization based on ASIC design尹遠(yuǎn)，黃嵩人（湘潭大學(xué)物理與光電工程學(xué)院，湖南 湘潭 411105）?????? 摘要：隨著芯片設(shè)計(jì)的復(fù)雜度和規(guī)模越來(lái)越大，現(xiàn)如今ASIC芯片的功耗要求也越來(lái)越高。低功耗設(shè)計(jì)作為一個(gè)重要目標(biāo)，需要設(shè)計(jì)者格外重視[1] 。在本文中，首先討論了功耗的組成及來(lái)源，闡述了在設(shè)計(jì)初期的功耗評(píng)估，以及功耗優(yōu)化的思路[1] 。接著描述了功耗優(yōu)化的具體操作
  • 關(guān)鍵字： 低功耗設(shè)計(jì)  功耗評(píng)估  功耗優(yōu)化  時(shí)鐘門控  201904  
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