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TMS320C672x系列浮點DSP的EMIF研究與應用

  • TMS320C672x系列浮點DSP的EMIF研究與應用,針對如何靈活應用高性能32／64位浮點DSP TMS320C672x提供的性能優(yōu)良的外部存儲器接口(EMIF)，分析了EMIF的特點和使用技巧，以TMS320C6722B型DSP為例，設計了EMIF與外部HY57V281620A型SDRAM和異步AM29LV800BB-90EC型Flash的硬件接口，并分析了EMIF訪問SDRAM和Flash時各控制寄存器配置的方法和具體步驟，列出了該配置命令下EMIF引腳與邏輯地址的對應關系和具體的軟件編寫例程；
  • 關鍵字： 研究  應用  EMIF  DSP  系列  浮點  TMS320C672x  

Cortex-M3內核浮點型運算的研究與實現(xiàn)

  • 摘要：通過分析Cortex-M3內核的結構與浮點型格式，充分利用Cortex-M3內核中的分支預測、單周期乘法、硬件除法等眾多功能強大的特性，使用Thumb-2指令集實現(xiàn)了單精度浮點型的加、減、乘、除與比較運算，并給出了加減法
  • 關鍵字： Cortex-M  內核  浮點  運算    

基于MATLAB在FPGA 算法上浮點定點轉換的實現(xiàn)

  • 基于MATLAB在FPGA 算法上浮點定點轉換的實現(xiàn),浮點定點轉換是在 FPGA 上實現(xiàn)算法時最困難的地方（圖 1）。雖然 MATLAB 是一種強大的運算開發(fā)工具，但其許多優(yōu)點卻在浮點定點轉換過程中被降低了。例如，由于定點算術中精度較低，新的數(shù)學誤差被引入算法。您必須重
  • 關鍵字： 定點  轉換  實現(xiàn)  浮點  算法  MATLAB  FPGA  基于  

基于FPGA的復數(shù)浮點協(xié)方差矩陣實現(xiàn)

  • 基于FPGA的協(xié)方差矩陣運算的實現(xiàn)大多采用的是定點計算方式，在運算過程中，存在數(shù)據(jù)處理動態(tài)范圍小，容易溢出，截斷誤差等問題。加之以空間譜估計為研究背景的協(xié)方差矩陣運算，大多得到的是針對特殊陣列模型的實對稱矩陣，不具備通用性。針對定點運算的不足和該運算的適用范圍，研究了浮點運算和復數(shù)運算的特點，提出了基于復數(shù)矢量的浮點協(xié)方差運算的FPGA實現(xiàn)方案。在Altera＼stratix＼EP1S20F780C7中的仿真和調試結果表明了該方案的有效性。
  • 關鍵字： FPGA  浮點  協(xié)方差矩陣    

基于SHARC 2147x處理器的浮點數(shù)字信號處理

  • 基于SHARC 2147x處理器的浮點數(shù)字信號處理,浮點數(shù)字信號處理已成為精密技術的一貫需求，航空、工業(yè)機器和醫(yī)療保健等領域要求較高精度的應用通常都有這個需求。醫(yī)療超聲設備是目前在用的最復雜的信號處理機器之一，并且逐漸向便攜式領域擴展。其面臨的挑戰(zhàn)在于
  • 關鍵字： 數(shù)字  信號處理  浮點  處理器  SHARC  2147x  基于  

一種高性能浮點DSP芯片TMS320C6713及其最小系統(tǒng)的設計

  • 一種高性能浮點DSP芯片TMS320C6713及其最小系統(tǒng)的設計,德州儀器公司推出的高性能浮點DSP芯片TMS320C6713顯著提高了嵌入式應用的性能,降低了系統(tǒng)設計的復雜度。介紹了該芯片的結構、特點和功能,進行了TMS320C6713最小系統(tǒng)的設計并闡述了PCB設計時的注意事項。
  • 關鍵字： 最小  系統(tǒng)  設計  及其  TMS320C6713  浮點  DSP  芯片  高性能  音頻  

高速流水線浮點加法器的FPGA實現(xiàn)

  • 本工程設計完全符合IP核設計的規(guī)范流程，而且完成了Verilog HDL建模、功能仿真、綜合、時序仿真等IP核設計的整個過程，電路功能正確。實際上，本系統(tǒng)在布局布線后，其系統(tǒng)的最高時鐘頻率可達80MHz。雖然使用浮點數(shù)會導致舍入誤差，但這種誤差很小，可以忽略。實踐證明，本工程利用流水線結構，方便地實現(xiàn)了高速、連續(xù)、大數(shù)據(jù)量浮點數(shù)的加法運算，而且設計結構合理，性能優(yōu)異，可以應用在高速信號處理系統(tǒng)中。
  • 關鍵字： FPGA  流水線  浮點  加法器    

充分發(fā)揮FPGA浮點IP內核的優(yōu)勢

  • 最近出現(xiàn)的 FPGA設計工具和 IP有效減少了計算占用的資源，大大簡化了浮點數(shù)據(jù)通路的實現(xiàn)。而且，與數(shù)字信號處理器不同， FPGA能夠支持浮點和定點混合工作的 DSP數(shù)據(jù)通路，實現(xiàn)的性能超過了 100 GFLOPS。在所有信
  • 關鍵字： FPGA  浮點  IP內核    

單精度浮點加法器的FPGA實現(xiàn)

  • 摘 要：在FPGA上實現(xiàn)單精度浮點加法器的設計，通過分析實數(shù)的IEEE 754表示形式和IEEE 754單精度浮點的存儲格式，設計出一種適合在FPGA上實現(xiàn)單精度浮點加法運算的算法處理流程，依據(jù)此算法處理流程劃分的各個處理模塊
  • 關鍵字： FPGA  精度  浮點  加法器    

浮點DSC使控制系統(tǒng)如虎添翼

  • 　　DSC（Digital signal controller，數(shù)字信號控制器）是一種面向高端嵌入式系統(tǒng)的最先進的單片控制處理器?；诟↑c架構的DSC具有更快的處理速度，所需的程序儲存容量更少，支持更高級的有助于節(jié)省功耗的計算算法，同時進一步擴展了系統(tǒng)的性能。浮點編程比定點編程的速度更快，SoC（system-on-a-chip，片上系統(tǒng)）的集成方式能夠有效控制板級空間、元件數(shù)量和整體系統(tǒng)開銷。 　　隨著嵌入式系統(tǒng)承擔的任務越來越復雜，不論是降低功耗還是實現(xiàn)諸如汽車導航之類的新功能，它們都需要具有更高性
  • 關鍵字： DSC  數(shù)字信號控制器  浮點  SoC  控制系統(tǒng)  

定點dsp與浮點dsp的比較

  •     定點運算DSP在應用中已取得了極大的成功，而且仍然是DSP應用的主體。然而，隨著對DSP處理速度與精度、存儲器容量、編程的靈活性和方便性要求的不斷提高、自80年代中后期以來，各DSP生產(chǎn)廠家陸續(xù)推出了各自的32bit浮點運算DSP。     和定點運算DSP相比，浮點運算DSP具有許多優(yōu)越性：     浮點運算DSP比定點運算DSP的動態(tài)范圍要大很多。定點DSP的字長每增加1bit,動態(tài)范
  • 關鍵字： 定點  浮點  dsp  嵌入式  

ARM體系下浮點數(shù)Middle-Endian問題的處理

  • 　　隨著嵌入式微處理器芯片性能的日益提高，嵌入式設備也得到了廣泛的應用。隨著應用的擴展，嵌入式軟件開發(fā)也呈現(xiàn)出功能多樣化、平臺多樣化、體系結構多樣化的特點。 　　由于可移植性好，相當一部分嵌入式軟件都是用C/C++語言開發(fā)的，而C/C++語言編寫的程序中數(shù)據(jù)存儲字節(jié)順序是與編譯平臺所用的CPU相關的，所以嵌入式軟件移植過程中，數(shù)據(jù)存儲字節(jié)順序是需要重點處理的地方。 　　在嵌入式GIS軟件從x86體系結構下移植到ARM體系結構的過程中，遇到了浮點數(shù)據(jù)存儲字節(jié)順序的問題。該問題既不是Big-Endian，
  • 關鍵字： 嵌入式系統(tǒng)  單片機  ARM  浮點  處理器  芯片  MCU和嵌入式微處理器  

32位單精度浮點乘法器的FPGA實現(xiàn)

  • 本文使用Altera Quartus II 4.1仿真軟件, 采用的器件是EPF10K100EQ 240 -1, 對乘法器進行了波形仿真, 并采用0.5CMOS工藝進行邏輯綜合。
  • 關鍵字： FPGA  精度  浮點  乘法器    

32位DSP設計中的流水線數(shù)據(jù)相關問題

  • 本文分析了該流水線的設計過程，并對遇到的數(shù)據(jù)相關問題提出了一種新的解決方法。...
  • 關鍵字： 浮點  哈佛  時鐘  指令  

德州儀器推出業(yè)界最低成本的浮點 DSP

  • 僅 5.75 美元的 TMS320C6720 DSP 為成本敏感型應用帶來方便的浮點功能 日前，德州儀器 (TI) 宣布推出業(yè)界成本最低的浮點 DSP TMS320C6720。該款 DSP 專門針對樂器、醫(yī)療、生物識別、無線電廣播、音頻會議、儀表以及工業(yè)應用等成本敏感型應用而設計，從而進一步豐富了業(yè)界最廣泛的 DSP 產(chǎn)品系列。包括 C6720 DSP（每萬
  • 關鍵字： DSP  單片機  德州儀器  浮點  嵌入式系統(tǒng)  最低成本  
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