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EEPW首頁 >> 主題列表 >> 狀態(tài)機(jī)

四種常用FPGA/CPLD設(shè)計(jì)思想與技巧之串并轉(zhuǎn)換

基于FPGA的電渦流緩速器控制系統(tǒng)

  •   摘 要:本文提出了一種基于FPAG芯片的控制系統(tǒng)設(shè)計(jì)方案。系統(tǒng)中利用FPGA狀態(tài)機(jī)高效地控制ADC進(jìn)行信號(hào)采集。在FPGA中搭建的模糊控制器通過對(duì)勵(lì)磁電流的連續(xù)調(diào)節(jié),實(shí)現(xiàn)了恒速、恒轉(zhuǎn)矩和恒流等控制策略。   關(guān)鍵詞:電渦流緩速器;FPGA;狀態(tài)機(jī);模糊控制   引言   電渦流緩速器的工作原理基于電磁感應(yīng)理論。作為一種輔助制動(dòng)裝置,其減少了主制動(dòng)裝置的機(jī)械摩擦,既提高了壽命,又提高了車輛行駛的安全性、經(jīng)濟(jì)性和舒適性,越來越受到汽車制造廠家的青睞。但是,由于汽車領(lǐng)域?qū)?shí)時(shí)性要求較高,且模糊控制算法
  • 關(guān)鍵字: 嵌入式系統(tǒng)  單片機(jī)  電渦流緩速器  FPGA  狀態(tài)機(jī)  MCU和嵌入式微處理器  

基于狀態(tài)機(jī)和流水線技術(shù)的3DES加密算法及其FPGA設(shè)計(jì)

  • 隨著網(wǎng)絡(luò)的快速發(fā)展,信息安全越來越引起人們的關(guān)注。加密技術(shù)作為信息安全的利器,正發(fā)揮著重大的作用。通過在硬件設(shè)備(如由器、交換機(jī)等)中添加解密功能,可使存儲(chǔ)和傳輸?shù)臄?shù)據(jù)具有較高的安全性。傳統(tǒng)的加密工作是通過在主機(jī)上運(yùn)行加密軟件實(shí)現(xiàn)的。這種方法除占用主機(jī)資源外,其運(yùn)算速度較硬件加密要慢,密鑰以明文的方式存儲(chǔ)在程序中,或者以加密的方式存儲(chǔ)在文件或數(shù)字庫中,重要數(shù)據(jù)(如個(gè)人密碼PIN等)會(huì)在某一時(shí)刻以明文形式出現(xiàn)在計(jì)算機(jī)的內(nèi)存或磁盤中,安全性較差。而硬件加密是通過獨(dú)立于主機(jī)系統(tǒng)外的硬件加密設(shè)備實(shí)現(xiàn)的,所有關(guān)鍵數(shù)
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GPIB接口的FPGA實(shí)現(xiàn)

  • 電子設(shè)計(jì)應(yīng)用2004年第10期摘    要:GPIB接口是測(cè)試儀器中常用的接口方式。通過將接口設(shè)計(jì)分解為同步狀態(tài)機(jī)設(shè)計(jì)和寄存器讀寫電路設(shè)計(jì),采用Verilog語言實(shí)現(xiàn)了滿足IEEE488.1協(xié)議的IP Core設(shè)計(jì)。將此IP Core固化到FPGA芯片中即可實(shí)現(xiàn)GPIB各種接口功能。關(guān)鍵詞:GPIB接口;狀態(tài)機(jī);FPGA引言在自動(dòng)測(cè)試領(lǐng)域中,GPIB通用接口是測(cè)試儀器常用的接口方式,具有一定的優(yōu)勢(shì)。通過GPIB組建自動(dòng)測(cè)試系統(tǒng)方便且費(fèi)用低廉。而GPIB控制芯片是自動(dòng)測(cè)試系統(tǒng)中
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狀態(tài)機(jī)介紹

關(guān)于狀態(tài)機(jī)的一個(gè)極度確切的描述是它是一個(gè)有向圖形,由一組節(jié)點(diǎn)和一組相應(yīng)的轉(zhuǎn)移函數(shù)組成。狀態(tài)機(jī)通過響應(yīng)一系列事件而“運(yùn)行”。每個(gè)事件都在屬于“當(dāng)前” 節(jié)點(diǎn)的轉(zhuǎn)移函數(shù)的控制范圍內(nèi),其中函數(shù)的范圍是節(jié)點(diǎn)的一個(gè)子集。函數(shù)返回“下一個(gè)”(也許是同一個(gè))節(jié)點(diǎn)。這些節(jié)點(diǎn)中至少有一個(gè)必須是終態(tài)。當(dāng)?shù)竭_(dá)終態(tài), 狀態(tài)機(jī)停止。   包含一組狀態(tài)集(states)、一個(gè)起始狀態(tài)(start state)、一組輸入符號(hào) [ 查看詳細(xì) ]

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