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EEPW首頁 >> 主題列表 >> 綜合實(shí)驗(yàn)

基于IP核的數(shù)字電路綜合實(shí)驗(yàn)

  • 目前IP core以及IP core的運(yùn)用是行業(yè)技術(shù)發(fā)展的一大趨勢。對(duì)EDA技術(shù)實(shí)驗(yàn)教學(xué)中的IP core的綜合運(yùn)用進(jìn)行了探討。所給出的例子都是利用Xilinx的ISE軟件,在其FPGA(SPARTAN3A and SPARTAN3AN系列)芯片上實(shí)現(xiàn)了的。文中所討論的基本要點(diǎn),對(duì)初學(xué)者如何理解設(shè)計(jì)重用和運(yùn)用IP core來進(jìn)行綜合型實(shí)驗(yàn)設(shè)計(jì)是有所幫助的。
  • 關(guān)鍵字: IP核  綜合實(shí)驗(yàn)  EDA  

ARM的綜合實(shí)驗(yàn)

  • ARM的綜合實(shí)驗(yàn)一、實(shí)驗(yàn)?zāi)康膶W(xué)習(xí)做一個(gè)復(fù)雜的應(yīng)用程序的方法和程序結(jié)構(gòu),結(jié)合應(yīng)用以前16 次實(shí)驗(yàn)所學(xué)到的知識(shí),編 ...
  • 關(guān)鍵字: ARM  綜合實(shí)驗(yàn)  
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綜合實(shí)驗(yàn)介紹

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