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EEPW首頁(yè) >> 主題列表 >> 編譯技術(shù)

Xilinx的增量編譯技術(shù)

  • 通常FPGA工程師編譯較大的工程時(shí)比較頭疼，因?yàn)榫幾g時(shí)間非常長(zhǎng)，常常需要花費(fèi)幾個(gè)小時(shí)，如果是在調(diào)試階段，每次修改一個(gè)錯(cuò)誤需要幾小時(shí)，這樣效率就非常低。導(dǎo)致編譯時(shí)間較長(zhǎng)的原因有兩點(diǎn)：1. 設(shè)計(jì)中資源利用比較大
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編譯技術(shù)介紹

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