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EEPW首頁 >> 主題列表 >> 設(shè)計技術(shù)

PCB版圖設(shè)計DD基于高速FPGA的PCB設(shè)計技術(shù)

  • 如果高速PCB設(shè)計能夠像連接原理圖節(jié)點(diǎn)那樣簡單，以及像在計算機(jī)顯示器上所看到的那樣優(yōu)美的話，那將是一件多么美好的事情。然而，除非設(shè)計師初入PCB設(shè)計，或者是極度的幸運(yùn)，實(shí)際的PCB設(shè)計通常不像他們所從事的電路設(shè)
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基于SOPC的簡易誤碼率測試儀設(shè)計技術(shù)

  • 介紹一種利用Altera公司Cyclone II系列FPGA和第2代軟核處理器Nios II的誤碼率測試儀的設(shè)計方法。該測試儀能夠滿足通信速率在40～175 Mbps的通信線路的誤碼率測量及通信質(zhì)量評估的要求，具有體積小、功耗低、成本低、測量靈活和易于軟硬件升級、硬件可重構(gòu)等優(yōu)勢，有著很高的實(shí)用價值和參考價值。
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淺談電子產(chǎn)品的可靠性設(shè)計

  • 文中給出了產(chǎn)品可靠性的定義及衡量可靠性的常見指標(biāo)。提出了電子產(chǎn)品可靠性設(shè)計一般應(yīng)遵循的原則。并重點(diǎn)介 ...
  • 關(guān)鍵字： 可靠性  設(shè)計技術(shù)  設(shè)計原則  
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設(shè)計技術(shù)介紹

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