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EEPW首頁 >> 主題列表 >> 雷達(dá)信號(hào)

AURIX TC3xx雷達(dá)信號(hào)處理CFAR算法詳解

  • CFAR是非常普遍的信號(hào)過濾手段，用于提取超過動(dòng)態(tài)閾值的點(diǎn)目標(biāo)信息。AURIX? TC3xx單片機(jī)的雷達(dá)信號(hào)處理單元SPU集成了該硬件功能，并且提供兩種典型的CFAR算法。英飛凌技術(shù)專家 錢偉喆背景介紹當(dāng)雷達(dá)回波信號(hào)功率幅值超過某個(gè)閾值時(shí)，能被檢測(cè)到，該閾值不可能是固定的，必須根據(jù)周圍環(huán)境、目標(biāo)分布反射強(qiáng)弱，雜波噪聲干擾等動(dòng)態(tài)變化，而CFAR（constant false alarm rate）就是用于計(jì)算動(dòng)態(tài)閾值的典型手段。CFAR直接影響檢測(cè)概率（probability of detection）【1
  • 關(guān)鍵字： 英飛凌  AURIX  雷達(dá)信號(hào)  CFAR  

基于FPGA嵌入式系統(tǒng)的雷達(dá)信號(hào)模擬器

基于CPLD的雷達(dá)仿真信號(hào)的設(shè)計(jì)

  • 雷達(dá)信號(hào)的仿真是測(cè)試系統(tǒng)中必不可少的。但采用函數(shù)/任意波發(fā)生器組成測(cè)試系統(tǒng)，不僅增加系統(tǒng)成本，而且還給系統(tǒng)軟件設(shè)計(jì)增加不必要的負(fù)擔(dān)。為此，提出了一種基于CPLD的雷達(dá)仿真信號(hào)的實(shí)現(xiàn)方案，它能為機(jī)載雷達(dá)測(cè)試系統(tǒng)提供所需的多種典型的重頻脈沖及制導(dǎo)信號(hào)。
  • 關(guān)鍵字： 雷達(dá)信號(hào)  任意波發(fā)生器  CPLD  

基于多相濾波結(jié)構(gòu)的雷達(dá)信號(hào)檢測(cè)技術(shù)

  • 在電子戰(zhàn)環(huán)境中，信號(hào)一般都具有復(fù)雜化、密集化的特點(diǎn)，占用的頻譜越來越寬，從而對(duì)雷達(dá)信號(hào)的檢測(cè)技術(shù)也提出了更 ...
  • 關(guān)鍵字： 多相濾波  雷達(dá)信號(hào)  檢測(cè)技術(shù)  

基于GUI的雷達(dá)信號(hào)抗分選性能評(píng)估系統(tǒng)

  • 摘要：為適應(yīng)現(xiàn)代戰(zhàn)場(chǎng)對(duì)雷達(dá)信號(hào)低截獲性能的需求，設(shè)計(jì)了雷達(dá)信號(hào)抗分選性能的評(píng)估系統(tǒng)，分析了雷達(dá)信號(hào)分選的常用算法包括累積差直方圖(CDIF)和序列差直方圖(SDIF)。模擬雷達(dá)信號(hào)環(huán)境，將設(shè)計(jì)的同步頻率捷變信號(hào)、
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基于ADSP21062的雷達(dá)信號(hào)處理系統(tǒng)的調(diào)試

  • 關(guān)鍵字：ADSP21062 雷達(dá) 信號(hào)處理ADSP2106x SHARC是一個(gè)適用于語音、通信和圖像處理的高速32位數(shù)字信號(hào)處理器。該芯片是基于ADSP21000系列DSP芯片發(fā)展起來的一個(gè)完整的單片系統(tǒng)，增加了一個(gè)雙口片內(nèi)SRAM，并集成了I/
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基于虛擬儀器的雷達(dá)信號(hào)模擬系統(tǒng)

  • 1引言傳統(tǒng)的雷達(dá)發(fā)射機(jī)，采用專用的信號(hào)發(fā)生模塊，無法任意的設(shè)置波形形式、參數(shù)，信號(hào)中心頻率，信號(hào)功...
  • 關(guān)鍵字： 虛擬儀器  雷達(dá)信號(hào)  模擬系統(tǒng)  

基于Spartan-6的船用雷達(dá)信號(hào)處理及顯控系統(tǒng)

  • 傳統(tǒng)的船用雷達(dá)信號(hào)處理和顯示控制系統(tǒng)都是采用FPGA+工控機(jī)方案，F(xiàn)PGA用于高速雷達(dá)信號(hào)的處理，工控機(jī)用于運(yùn)行操作系統(tǒng)、實(shí)現(xiàn)圖形用戶界面。這種方案的優(yōu)點(diǎn)是利用了FPGA和工控機(jī)各自的優(yōu)點(diǎn)進(jìn)行了合理的搭配，缺點(diǎn)是增加了系統(tǒng)的復(fù)雜度、成本高、系統(tǒng)的穩(wěn)定性降低。
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PC1O4總線雷達(dá)信號(hào)顯示卡的設(shè)計(jì)與實(shí)現(xiàn)

  • 摘要：PC104總線雷達(dá)信號(hào)顯示卡是將基于PC104總線的虛擬儀器技術(shù)應(yīng)用于通用雷達(dá)嵌入式診斷組合中信號(hào)的顯示，對(duì)于改進(jìn)雷達(dá)裝備故障檢測(cè)方式具有重大意義。通過對(duì)信號(hào)波形顯示原理以及顯示方法的分析，確定了具體的實(shí)
  • 關(guān)鍵字： PC1O4  總線  雷達(dá)信號(hào)  卡的設(shè)計(jì)    

應(yīng)用虛擬儀器對(duì)雷達(dá)信號(hào)系統(tǒng)模擬

  • 　1 引言

    傳統(tǒng)的雷達(dá)發(fā)射機(jī)，采用專用的信號(hào)發(fā)生模塊，無法任意的設(shè)置波形形式、參數(shù)，信號(hào)中心頻率，信號(hào)功率等。在一定程度上限制了應(yīng)用范圍。尤其在雷達(dá)的預(yù)研和新技術(shù)的探索階段，要對(duì)各種雷達(dá)信號(hào)進(jìn)行實(shí)驗(yàn)或
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一種基于FPGA的雷達(dá)脈沖預(yù)分選器設(shè)計(jì)

  • 0引言現(xiàn)代電子戰(zhàn)環(huán)境日趨復(fù)雜，信號(hào)日趨密集，新體制雷達(dá)不斷出現(xiàn)，雷達(dá)信號(hào)的各個(gè)參數(shù)以各種規(guī)律變化，...
  • 關(guān)鍵字： FPGA  雷達(dá)信號(hào)  雷達(dá)脈沖預(yù)分選器  

基于ADSP21062的雷達(dá)信號(hào)處理系統(tǒng)

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
  • 關(guān)鍵字： ADSP21062  雷達(dá)信號(hào)  DSP算法  時(shí)鐘計(jì)數(shù)  

基于FPGA技術(shù)的模擬雷達(dá)信號(hào)實(shí)現(xiàn)

  • 前言 FPGA（現(xiàn)場(chǎng)可編程門陣列）是由掩膜可編程門陣列和PLD（可編程邏輯器件）演變而來的，并將二者的特性結(jié)合在一起，使FPGA既有掩膜可編程門陣列的高邏輯密度和通用性，又有PLD的可編程特性。FPAG技術(shù)的發(fā)展使得
  • 關(guān)鍵字： FPGA  模擬  雷達(dá)信號(hào)    

基于VC++雷達(dá)信號(hào)系統(tǒng)軟件測(cè)試平臺(tái)的設(shè)計(jì)

  • 隨著電子計(jì)算機(jī)技術(shù)及電子設(shè)備的飛速發(fā)展，人們對(duì)數(shù)據(jù)的處理容量、處理速度以及工作平臺(tái)的實(shí)時(shí)監(jiān)控等性能的要求越來越高，從而使得高速、便捷、智能化的高性能數(shù)字處理設(shè)備成為當(dāng)今電子設(shè)備的發(fā)展趨勢(shì)。
  • 關(guān)鍵字： VC  雷達(dá)信號(hào)  測(cè)試平臺(tái)  系統(tǒng)軟件    

用FPGA技術(shù)實(shí)現(xiàn)模擬雷達(dá)信號(hào)

  • 前言FPGA（現(xiàn)場(chǎng)可編程門陣列）是由掩膜可編程門陣列和PLD（可編程邏輯器件）演變而來的，并將二者的特性結(jié)合在一起，使FPGA既有掩膜可編程門陣列的高邏輯密度和通用性，又有PLD的可編程特性。FPAG技術(shù)的發(fā)展使得單個(gè)
  • 關(guān)鍵字： FPGA  技術(shù)實(shí)現(xiàn)  模擬  雷達(dá)信號(hào)    
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