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EEPW首頁 >> 主題列表 >> 靜態(tài)功耗

靜態(tài)功耗 文章 進入靜態(tài)功耗技術社區(qū)

FPGA設計中功耗的分析與仿真

  • FPGA的應用越來越廣泛，隨著制造工藝水平的不斷提升，越來越高的器件密度以及性能使得功耗因數(shù)在FPGA設計中越來越重要。器件中元件模塊的種類和數(shù)量對FPGA設計中功耗的動態(tài)范圍影響較大，對FPGA的電源功耗進行了分析
  • 關鍵字： FPGA    靜態(tài)功耗    動態(tài)功耗    觸發(fā)率  

減小元件中動態(tài)和靜態(tài)功耗方法解析方案

  • 結合采用低功耗元件和低功耗設計技術在目前比以往任何時候都更有價值。隨著元件集成更多功能，并越來越小型化，對低功耗的要求持續(xù)增長。當把可編程邏輯器件用于低功耗應用時，限制設計的低功耗非常重要。本文將討論
  • 關鍵字： 元件  動態(tài)  靜態(tài)功耗  方法    

射極跟隨器輸出電路的靜態(tài)功耗

  • 圖2.9舉例說明了一個ECL或GAAS射極跟隨器輸出電路。該電路在HI和LO兩個狀態(tài)都有電流流過。對于10KH和10G產品系列，兩者的邏輯HI和LO輸出電壓都是相近的，盡管不同的ECL和GAAS射極耦合邏輯系列在溫度軌跡特性上存在細
  • 關鍵字： 射極跟隨器  靜態(tài)功耗  輸出電路    

推拉輸出電路中的靜態(tài)功耗

  • 一旦推拉輸出電路完全轉換，靜態(tài)功耗等于源電流乘以導通臂上的剩余電壓。我們將分別計算出LO和HI狀態(tài)下的功率，然后取二者的平均值。圖2.6說明了理想的TT驅動器在LO和HI狀態(tài)下的功耗。對于標準的TTL器件，Q2處于飽和
  • 關鍵字： 推拉輸出電路  靜態(tài)功耗    

通用微處理器等效老化試驗方法分析與研究

利用Virtex-5 FPGA實現(xiàn)最低功耗解決方案

  • 　　過渡至65納米工藝的FPGA具備采用更小尺寸工藝所帶來的優(yōu)勢：低成本、高性能和更強的邏輯能力。盡管這些優(yōu)勢能夠為高級系統(tǒng)設計帶來激動人心的機會，但65納米工藝節(jié)點本身也帶來了新的挑戰(zhàn)。例如，在為產品選擇FPGA時，功耗的考慮變得越來越重要。很可能下一代設計會需要在功耗預算不變(或更小)的情況下，集成更多的特性和實現(xiàn)更高的性能。 　　本文將分析功耗降低所帶來的益處，還將介紹Virtex-5器件中所采用的多種技術和結構上的革新，它們能提供功耗最低的解決方案，并且不犧牲性能。 　　降低功耗的好處 　　
  • 關鍵字： FPGA  低功耗  Virtex-5  靜態(tài)功耗  動態(tài)功耗  

3G手機技術發(fā)展與設計架構(4)

液晶顯示器電源管理的電路設計

Actel低功耗的FPGA系列靜態(tài)功耗僅為5µW

  • 　　Actel 公司宣布推出業(yè)界最低功耗的現(xiàn)場可編程門陣列 (FPGA) -- IGLOO™ 系列。這個以 Flash 為基礎的產品系列的靜態(tài)功耗為5µW，是最接近競爭產品功耗的四分之一；與目前領先的PLD產品比較，更可延長便攜式應用的電池壽命達5倍，因而奠定了低功耗的新標準。 　　   　　由于便攜式產品的生命周期短及市場競爭激烈，設計人員必需不斷增加新的功能和復雜性，但卻不能耗用
  • 關鍵字： Actel  FPGA  單片機  靜態(tài)功耗  嵌入式系統(tǒng)  通訊  網絡  無線  
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靜態(tài)功耗介紹

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