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基于Avalon-ST接口幀讀取IP核的設(shè)計(jì)和應(yīng)用

  • 研究基于Avalon-ST接口幀讀取的IP核設(shè)計(jì)應(yīng)用，通過Avalon-ST接口將外部存儲(chǔ)中不同格式的幀數(shù)據(jù)轉(zhuǎn)化為視頻流輸出。根據(jù)Avalon總線協(xié)議及Avalon-ST視頻協(xié)議研究設(shè)計(jì)方案，使用Verilog HDL語言對(duì)模塊進(jìn)行硬件設(shè)計(jì)，并將實(shí)現(xiàn)的模塊進(jìn)行測(cè)試。
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基于Avalon總線的鍵盤和VGA控制接口設(shè)計(jì)

  • 　　引言　　SOPC(System On Programmable Chip，可編程的片上系統(tǒng))是Altera公司提出的一種靈活、高效的SOC解決方案。它將處理器、存儲(chǔ)器、I/O口等系統(tǒng)設(shè)計(jì) 需要的功能模塊集成到一個(gè)可編程器件上，構(gòu)成一個(gè)可編程的片上系統(tǒng)。SOPC是PLD和ASIC技術(shù)融合的結(jié)果，代表了半導(dǎo)體產(chǎn)業(yè)未來的發(fā)展方向?！　ltera公司的Nios II核是目前最具代表性的軟核嵌入式系統(tǒng)處理器，本文描述的SOPC系統(tǒng)以Altera Ni
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跳上Avalon總線：一種簡(jiǎn)化的FPGA接口

  • 　　引言　　許多新式FPGA設(shè)計(jì)采用了一些用于控制的嵌入式處理器。一種典型解決方案需要使用諸如NIOS等嵌入式軟處理器。另一種解決方案則使用包含一個(gè)內(nèi)置硬處理器的SoC(片上系統(tǒng))器件。圖1所示為一個(gè)典型的Altera?FPGA系統(tǒng)，該系統(tǒng)包含處理器和一系列通過Avalon內(nèi)存映射(MM)總線連接的外設(shè)。這些處理器極大地簡(jiǎn)化了最終應(yīng)用，但是要求開發(fā)人員擁有堅(jiān)實(shí)的編程背景和精細(xì)復(fù)雜工具鏈的相關(guān)知識(shí)。這會(huì)阻礙調(diào)試工作的推進(jìn)，特別是如果硬件工程師需要一種不會(huì)煩擾軟件工程師即可完成外設(shè)讀寫的簡(jiǎn)單方法?！?/li>
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FPGA研發(fā)之道(18)-設(shè)計(jì)不是湊波形(八)總線（上）

  • 　　如果設(shè)計(jì)中有多個(gè)模塊，每個(gè)模塊內(nèi)部有許多寄存器或者存儲(chǔ)塊需要配置或者提供讀出那么實(shí)現(xiàn)方式有多種，主要如下： 　　實(shí)現(xiàn)方式一：可以在模塊頂部將所有寄存器引出，提供統(tǒng)一的模塊進(jìn)行配置和讀出。這種方式簡(jiǎn)單是簡(jiǎn)單，但是頂層連接工作量較大，并且如果配置個(gè)數(shù)較多，導(dǎo)致頂層中寄存器的數(shù)目也會(huì)較多。 　　實(shí)現(xiàn)方式二：通過總線進(jìn)行連接，為每個(gè)模塊分配一個(gè)地址范圍。這樣寄存器等擴(kuò)展就可以在模塊內(nèi)部進(jìn)行擴(kuò)展，而不用再頂層進(jìn)行過多的頂層互聯(lián)。如下圖所示： 　　 ? 　　那如果進(jìn)行總線的選擇，那么有一種
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FPGA研發(fā)之道—總線

  • 　　如果設(shè)計(jì)中有多個(gè)模塊，每個(gè)模塊內(nèi)部有許多寄存器或者存儲(chǔ)塊需要配置或者提供讀出那么實(shí)現(xiàn)方式有多種，主要如下： 　　實(shí)現(xiàn)方式一：可以在模塊頂部將所有寄存器引出，提供統(tǒng)一的模塊進(jìn)行配置和讀出。這種方式簡(jiǎn)單是簡(jiǎn)單，但是頂層連接工作量較大，并且如果配置個(gè)數(shù)較多，導(dǎo)致頂層中寄存器的數(shù)目也會(huì)較多。 　　實(shí)現(xiàn)方式二：通過總線進(jìn)行連接，為每個(gè)模塊分配一個(gè)地址范圍。這樣寄存器等擴(kuò)展就可以在模塊內(nèi)部進(jìn)行擴(kuò)展，而不用再頂層進(jìn)行過多的頂層互聯(lián)。如下圖所示： 　　   　　那如果進(jìn)行總線的選擇，那么有一種
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基于Avalon總線SHT11溫濕度傳感器自定義IP核開發(fā)流程

  • 引言SOPC(System On a Programmable Chip,可編程芯片系統(tǒng))就是在一個(gè)可編程芯片上實(shí)現(xiàn)一個(gè)電子系統(tǒng)的技術(shù)。SOPC是可編程邏輯器件技術(shù)和SoC(System on Chip)技術(shù)發(fā)展與融合的產(chǎn)物[12]。SOPC的關(guān)鍵技術(shù)之一就是IP核，
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基于Avalon總線的TFT LCD控制器設(shè)計(jì)

  • 系統(tǒng)總體設(shè)計(jì)方案Nios II處理器在SDRAM中開辟幀緩沖(Frame buffer)，可以是單緩沖也可以是雙緩沖。以單緩沖為例。處理器將一幀圖像數(shù)據(jù)(640times;480times;2Bytes，RGB565，16bit)存入幀緩沖，然后將幀緩沖的首地址
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NiosⅡ系統(tǒng)Avalon總線PWM設(shè)計(jì)

  • 在NiosⅡ系統(tǒng)的構(gòu)建過程中，SoPC Builder開發(fā)環(huán)境集成了許多常用類型的設(shè)備模型，供開發(fā)者調(diào)用。在日新月異的嵌入式系統(tǒng)設(shè)計(jì)中開發(fā)環(huán)境所集成的接口設(shè)備是非常有限的，有時(shí)無法滿足開發(fā)者的需要，SoPC Builder開發(fā)工
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基于Avalon總線的SD卡讀寫控制器的設(shè)計(jì)

  • 介紹Altera公司提出的SoPC技術(shù)，根據(jù)SoPC系統(tǒng)Avalon總線規(guī)范，設(shè)計(jì)一種同時(shí)包含Master和Slave端口的SD卡讀寫控制器，無需CPU的干預(yù)，并且支持中斷，大大提高了SD卡的讀／寫速度。該設(shè)計(jì)的核心部分為SD卡讀／寫時(shí)序控制以及Avalon-MM總線與NiosⅡ的接口部分。該控制器在友晶科技DE2開發(fā)平臺(tái)上驗(yàn)證通過，實(shí)現(xiàn)了大數(shù)據(jù)量的快速存取，滿足了一般消費(fèi)類電子需求，具有較大的應(yīng)用前景。
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三種常用SoC片上總線的分析與比較

  • 嵌入式系統(tǒng)是當(dāng)今計(jì)算機(jī)工業(yè)發(fā)展的一個(gè)熱點(diǎn)。隨著超大規(guī)模集成電路的迅速發(fā)展，半導(dǎo)體工業(yè)進(jìn)入深亞微米時(shí)代，器件特征尺寸越來越小，芯片規(guī)模越來越大，可以在單芯片上集成上百萬到數(shù)億只晶體管。如此密集的集成度使我們現(xiàn)在能夠在一小塊芯片上把以前由CPU和若干I/O接口等數(shù)塊芯片實(shí)現(xiàn)的功能集成起來，由單片集成電路構(gòu)成功能強(qiáng)大的、完整的系統(tǒng)，這就是我們通常所說的片上系統(tǒng)SoC（System on Chip）。由于功能完整，SoC逐漸成為嵌入式系統(tǒng)發(fā)展的主流。  　　SoC相比板上系統(tǒng)，具有許
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