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SpringSoft發(fā)布Verdi自動偵錯系統(tǒng)低功耗設(shè)計(jì)感知偵錯模塊

  • 　　專業(yè)IC設(shè)計(jì)軟件全球供貨商SpringSoft, Inc.今天發(fā)表該公司獲獎無數(shù)的Verdi自動偵錯系統(tǒng)全新低功耗設(shè)計(jì)感知偵錯模塊。低功耗設(shè)計(jì)感知偵錯加速功耗設(shè)計(jì)意圖的理解，并使其直觀化、追蹤與分析功耗相關(guān)錯誤的流程自動化。這個模塊與Verdi系統(tǒng)的硬件描述語言(HDL)偵錯功能完全整合，這是SpringSoft的Novas驗(yàn)證流程強(qiáng)化解決方案產(chǎn)品系列的基石，讓工程師的驗(yàn)證工作事半功倍。 　　SpringSoft的低功耗設(shè)計(jì)感知偵錯同時具備了一致化功耗格式(United Power Format，U
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Cadence與UMC推出65納米低功耗參考設(shè)計(jì)流程

  • 　　全球電子設(shè)計(jì)創(chuàng)新企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司 (NASDAQ: CDNS)與領(lǐng)先的全球半導(dǎo)體晶圓廠UMC (NYSE: UMC, TSE: 2303)今天宣布推出基于通用功率格式（CPF）的低功耗參考設(shè)計(jì)流程，面向UMC 65納米工藝。該參考流程讓客戶能夠在使用UMC的低功耗套件時實(shí)現(xiàn)最佳的65納米低功耗設(shè)計(jì)，該套件中包含了基于CPF的庫和其他知識產(chǎn)權(quán)。 　　這種65納米低功耗參考流程使用UMC的“Leon”測試芯片作為參考設(shè)計(jì)。Leon是一個開放源碼的32位RISC微處理
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VERISILICON加盟“功耗前鋒倡議”加速高級低功耗設(shè)計(jì)

  • 　　世界級ASIC設(shè)計(jì)晶圓廠及定制解決方案供應(yīng)商VeriSilicon Holdings Co., Ltd.（VeriSilicon）“已經(jīng)加盟功耗前鋒倡議”（ Power Forward Initiative，PFI），計(jì)劃為其ASIC客戶提供基于通用功率格式（Common Power Format，CPF）的設(shè)計(jì)解決方案。 　　VeriSilicon采用Cadence低功耗解決方案，是業(yè)界領(lǐng)先的完整的設(shè)計(jì)流程，以Si2標(biāo)準(zhǔn)的CPF為基礎(chǔ)，貫穿邏輯設(shè)計(jì)、驗(yàn)證、實(shí)現(xiàn)等技術(shù)。這種針
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SMIC推出基于CPF的CADENCE 低功耗數(shù)字參考流程

  • 　　中芯國際集成電路制造有限公司與Cadence設(shè)計(jì)系統(tǒng)有限公司，今天宣布 SMIC 正推出一種基于通用功率格式 (CPF) 的90納米低功耗數(shù)字參考流程，以及兼容 CPF 的庫。SMIC 還宣布其已經(jīng)加盟功率推進(jìn)聯(lián)盟 (PFI)。 　　這種新流程使用了由 SMIC 開發(fā)的知識產(chǎn)權(quán)，并應(yīng)用了 Cadence 設(shè)計(jì)系統(tǒng)有限公司 (Nasdaq: CDNS) 的低功耗解決方案，其設(shè)計(jì)特點(diǎn)是可提高生產(chǎn)力、管理設(shè)計(jì)復(fù)雜性，并縮短上市時間。這種流程是 Cadence 與 SMIC 努力合作的結(jié)晶，進(jìn)一步強(qiáng)化了彼此
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SMIC推出基于CPF的CADENCE低功耗數(shù)字參考流程

  • 　　半導(dǎo)體晶圓廠中芯國際集成電路制造有限公司(SMIC)與電子設(shè)計(jì)創(chuàng)新企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS)，今天宣布SMIC正推出一種基于通用功率格式(CPF)的90納米低功耗數(shù)字參考流程，以及兼容CPF的庫。SMIC還宣布其已經(jīng)加盟Power Forward Initiative(PFI)。 　　這種新流程使用了由SMIC開發(fā)的知識產(chǎn)權(quán)，并應(yīng)用了Cadence設(shè)計(jì)系統(tǒng)公司 (NASDAQ: CDNS) 的低功耗解決方案，其設(shè)計(jì)特點(diǎn)是可提高生產(chǎn)力、管理設(shè)計(jì)復(fù)雜性，并縮短上市時間。這
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Cadence推出第一套完整支持CPF的解決方案

  • 　　Cadence推出了Cadence Low-Power Solution，這是用于低功耗芯片的邏輯設(shè)計(jì)、驗(yàn)證和實(shí)現(xiàn)的業(yè)界第一套完全集成的、標(biāo)準(zhǔn)化的流程。Cadence Low-Power Solution將領(lǐng)先的設(shè)計(jì)、驗(yàn)證和實(shí)現(xiàn)技術(shù)與Si2 Common Power Format （CPF）相集成，為IC工程師提供端到端的低功耗設(shè)計(jì)方案。CPF是在設(shè)計(jì)過程初期詳細(xì)定義節(jié)約功耗技術(shù)的標(biāo)準(zhǔn)化格式。通過在整個設(shè)計(jì)過程中保存低功耗
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