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工程師設(shè)計手冊：集成“硬”IP模塊的幾點(diǎn)建議

  • 對“硬”IP模塊—那些以GDSII數(shù)據(jù)庫形式提交的模塊—的集成，讓系統(tǒng)設(shè)計工程師能夠把某些過去不得不在公...
  • 關(guān)鍵字： IP模塊  工程師經(jīng)驗談  GDSII  

Cadence推出新一代Encounter RTL-to-GDSII流程

  • 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ: CDNS)，日前宣布推出最新版Cadence? Encounter? RTL-to-GDSII流程，面向高性能千兆級設(shè)計，包括在20納米最新技術(shù)節(jié)點(diǎn)上的新設(shè)計。這種最新的RTL-to-GDSII設(shè)計、實(shí)現(xiàn)與簽收流程是與領(lǐng)先的IP與晶圓廠合作伙伴及客戶合作開發(fā)的，能更有效地進(jìn)行SoC開發(fā)，滿足并超越當(dāng)今市場所需的功耗、性能與面積需求。
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采用高級節(jié)點(diǎn)ICs實(shí)現(xiàn)從概念到推向消費(fèi)者的最快途徑(08-100)

  • 　　在一個依靠消費(fèi)者對更精密產(chǎn)品的需求越來越高的市場里，半導(dǎo)體公司正在迅速地向45納米、以及更小的高級工藝節(jié)點(diǎn)發(fā)展。這些技術(shù)帶來了芯片質(zhì)量和性能的大大提升，在系統(tǒng)級芯片上實(shí)現(xiàn)了更高級的復(fù)雜應(yīng)用功能整合程度。然而，隨著更多的設(shè)計進(jìn)化到高級技術(shù)，半導(dǎo)體公司面臨的設(shè)計挑戰(zhàn)也在激增，無法確保迅速量產(chǎn)的風(fēng)險也在提高。
  • 關(guān)鍵字： Cadence  ICs  GDSII  

CADENCE與Common Platform及ARM合作提供45納米RTL-to-GDSII參考流程

  • 　　全球電子設(shè)計創(chuàng)新企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ: CDNS)今天宣布面向Common Platform™技術(shù)的45納米參考流程將于2008年7月面向大眾化推出。Cadence®與Common Platform技術(shù)公司包擴(kuò)IBM、特許半導(dǎo)體制造公司和三星聯(lián)合開發(fā)RTL-to-GDSII 45納米流程，滿足高級節(jié)點(diǎn)設(shè)計需要。該參考流程基于對應(yīng)Common Power Format（CPF）的Cadence低功耗解決方案，而且還包含來自Cadence的關(guān)鍵可制造性設(shè)計（De
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