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MIMO-OFDMA無線基站的DSP-FPGA系統(tǒng)劃分

  • 引言 　　無線運營商通過提供增強數(shù)據(jù)服務來提高單位用戶平均收益(ARPU)，這同時推動了對寬帶的需求，導致對數(shù)據(jù)速率的要求越來越高。而且，為用戶提供各種應用體驗的要求也促使底層網(wǎng)絡體系結(jié)構(gòu)進行變革。窄帶2G GSM、IS-95系統(tǒng)等以語音為中心的技術(shù)已經(jīng)發(fā)展到了基于WCDMA的HSDPA和HSUPA系統(tǒng)，峰值數(shù)據(jù)速率達到了10Mbps。今后的3GPP長期發(fā)展規(guī)范采用了多輸入多輸出(MIMO)等復雜的信號處理技術(shù)，以及正交頻分復用接入(OFDMA)和多載波碼分復用接入(MC-CDMA)等新的射頻技術(shù)，這些
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基于USB2.0與FPGA技術(shù)的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計

  • 　　近年來筆記本電腦迅速普及和更新，其中大部分已經(jīng)不配置RS232接口，而USB接口已成為今后一段時間PC機與外設(shè)接口的主流。本采集系統(tǒng)的設(shè)計構(gòu)建了一個基于USB接口的多功能通用數(shù)據(jù)采集、傳輸平臺，將嵌入式系統(tǒng)的實時性、靈活性和PC機強大的數(shù)據(jù)存儲、處理、顯示功能結(jié)合起來。該采集系統(tǒng)在智能儀器儀表、測控系統(tǒng)、工控系統(tǒng)等領(lǐng)域有廣闊的應用前景。 1 系統(tǒng)總體結(jié)構(gòu)設(shè)計 　　1.1 系統(tǒng)總體結(jié)構(gòu) 　　系統(tǒng)總體結(jié)構(gòu)框圖如圖1所示，系統(tǒng)包括：單片機與USB接口模塊、FPGA模塊、信號調(diào)理及A/D模塊。其中，單片
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基于DSP的嵌入式顯微圖像處理系統(tǒng)的設(shè)計

  • 　　顯微圖像處理是數(shù)字圖像處理的一個重要研究領(lǐng)域，隨著其技術(shù)的不斷發(fā)展，已經(jīng)在材料、生物、醫(yī)學等領(lǐng)域得到了廣泛應用[1][2]。目前的顯微圖像處理通常利用圖像采集系統(tǒng)將顯微圖像采集到計算機中再進行圖像處理，這樣，雖然運算速度高，但體積龐大、不便于攜帶，有一定的局限性。因此，采用數(shù)字圖像處理技術(shù)和DSP技術(shù)實現(xiàn)顆粒顯微圖像的高效、快速、全面的統(tǒng)計與測量，具有重要的實用價值和廣闊的應用前景。     本文提出并設(shè)計了一種基于DSP和FPGA的嵌入式顯微圖像采集處理系統(tǒng)，如圖1所
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GE Fanuc智能設(shè)備推出首個加固XMCV5夾層卡

  • 　　針對數(shù)字信號處理應用而設(shè)計；可應用于最惡劣的環(huán)境當中 　　* Xilinx Virtex FPGA 處理器 　　* 5種加固選項 　　* 靈活配置選項 　　* 兼容 VITA-42.0、VITA 42.2 和VITA 42.3 　　GE Fanuc 智能設(shè)備近日發(fā)布支持Xilinx Virtex-5 FPGA 的XMCV5夾層卡，以滿足軍事和航空領(lǐng)域客戶日益增長的對FPGA技術(shù)的需求。我們設(shè)計的XMCV5應用范圍十分廣泛，在數(shù)字信號(DSP)處理應用方面，可應用于地面移動通信、飛機固定和旋
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Spartan-3 FPGA系列中高效PCB布局的LVDS信號倒相

  • 　　提要 　　在比較簡單的未大量使用過孔的四層或六層 PCB 上，可能很難對 LVDS 或 LVPECL 這類差分信號布線。其原因是，驅(qū)動器上的正極引腳必須驅(qū)動接收器上的相應正極引腳，而負極引腳則必須驅(qū)動接收器的負極引腳。有時跡線以錯誤的方向結(jié)束，這實際上是向電路中添加了一個倒相器。本應用指南說明 Spartan?- 3 FPGA 系列如何僅通過在接收器數(shù)據(jù)通路中加入一個倒相器即可避免大量使用過孔，并且在不要求 PCB 重新設(shè)計的情況下即可解決意外的 PCB 跡線交換問題。這項技術(shù)同樣適用于將 FPGA
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3G系統(tǒng)中AGC的FPGA設(shè)計實現(xiàn)

  • 　　1 引 言  　　大多數(shù)接收機必須處理動態(tài)范圍很大的信號，這需要進行增益調(diào)整，以防止過載或某級產(chǎn)生互調(diào)，調(diào)整解調(diào)器的工作以優(yōu)化工作。在現(xiàn)代無線電接收裝置中?？勺冊鲆娣糯笃魇请娍氐?，并且當接收機中使用衰減器時，他們通常都是由可變電壓控制的連續(xù)衰減器。控制應該是平滑的并且與輸入的信號能量通常成對數(shù)關(guān)系(線性分貝)。在大多數(shù)情況下，由于衰落，AGC通常用來測量輸入解調(diào)器的信號電平，并且通過反饋控制電路把信號電平控制在要求的范同內(nèi)。 　　2 系統(tǒng)總體設(shè)計 　　在本設(shè)計中，前端TD_SCDM
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利用FPGA實現(xiàn)工業(yè)以太網(wǎng)交換機設(shè)計優(yōu)化

  • 利用FPGA實現(xiàn)工業(yè)以太網(wǎng)交換機設(shè)計優(yōu)化,工業(yè)以太網(wǎng)技術(shù)一直在進步，并越來越普及，而設(shè)計師面臨著對高性價比工業(yè)交換機日益強勁的需求?；贏SIC和ASSP的交換機因其架構(gòu)固定，所以實際上沒有余地定制出新的系統(tǒng)特性。為了增加特性設(shè)計一般要推倒重來，此舉會導致額外的設(shè)計時間和成本支出。但如上所述的支持IEEE 1588交換機的FPGA設(shè)計可節(jié)省6到9個月的工程時間，并提供給設(shè)計師夢寐以求的靈活性，幫助他們實現(xiàn)精確定時協(xié)議（PTP）、 支持多個工業(yè)以太網(wǎng)標準、額外的標準接口或者其它可能的定制特性。
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在高清晰LCD HDTV中使用Cyclone III FPGA

  • 　　引言 　　當今的液晶顯示(LCD) 技術(shù)在高清晰電視(HDTV) 領(lǐng)域得到了廣泛應用，其挑戰(zhàn)在于如何獲得更高的分辨率，實現(xiàn)更快的數(shù)據(jù)速率。提高數(shù)據(jù)速率需要專業(yè)圖像處理算法來支持快速移動的視頻。業(yè)界遇到的主要問題是：怎樣實現(xiàn)這些算法，率先將產(chǎn)品推向市場，并且能夠控制好產(chǎn)品功耗? 　　為解決這一問題，當硬件平臺和不同尺寸的LCD 顯示屏連接時，設(shè)計人員需要確定怎樣重新配置圖像處理算法。面積較大的LCD 顯示屏需要更快的數(shù)據(jù)速率，因此，難點在于怎樣根據(jù)顯示屏大小來調(diào)整數(shù)據(jù)速率。 　　采用新的低成本Cy
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立體液晶顯示器的圖像獲取及顯示

  • 　　立體液晶顯示器是近年來新出現(xiàn)的虛擬現(xiàn)實顯示設(shè)備，它真實地再現(xiàn)場景的三維信息，顯示具有縱深感的圖像。其最大特點就是觀察者無需使用任何附加設(shè)備，直接用肉眼就可看到屏幕上顯示的立體圖像。觀測者可以更容易、更快速地理解真實的景深信息，更全面、更直觀地洞察圖像空間位置的實際分布狀況。 　　目前，國內(nèi)外的自由立體液晶顯示方式通常采用計算機采集圖像并存儲，處理后輸出到液晶屏驅(qū)動電路板，然后通過板載模數(shù)轉(zhuǎn)換模塊等處理后在液晶屏顯示立體圖像。這種方式主要由計算機進行圖像采集和處理，其開發(fā)周期短，但成本較高，體積較大，
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FPGA設(shè)計開發(fā)中應用仿真技術(shù)解決故障的方法

  • 　　本文針對FPGA實際開發(fā)過程中，出現(xiàn)故障后定位困難、反復修改代碼編譯時間過長、上板后故障解決無法確認的問題，提出了一種采用仿真的方法來定位、解決故障并驗證故障解決方案?？梢源蟠蟮墓?jié)約開發(fā)時間，提高開發(fā)效率。 　　FPGA近年來在越來越多的領(lǐng)域中應用，很多大通信系統(tǒng)（如通信基站等）都用其做核心數(shù)據(jù)的處理。但是過長的編譯時間，在研發(fā)過程中使得解決故障的環(huán)節(jié)非常令人頭痛。本文介紹的就是一種用仿真方法解決故障從而減少研發(fā)過程中的編譯次數(shù)，最終達到準確定位故障、縮短解決故障時間的目的。文例所用到的軟件開發(fā)平臺
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影響FPGA設(shè)計中時鐘因素的探討

  • 　　時鐘是整個電路最重要、最特殊的信號，系統(tǒng)內(nèi)大部分器件的動作都是在時鐘的跳變沿上進行, 這就要求時鐘信號時延差要非常小, 否則就可能造成時序邏輯狀態(tài)出錯；因而明確FPGA設(shè)計中決定系統(tǒng)時鐘的因素，盡量較小時鐘的延時對保證設(shè)計的穩(wěn)定性有非常重要的意義。 　　1.1 建立時間與保持時間 　　建立時間（Tsu：set up time）是指在時鐘沿到來之前數(shù)據(jù)從不穩(wěn)定到穩(wěn)定所需的時間，如果建立的時間不滿足要求那么數(shù)據(jù)將不能在這個時鐘上升沿被穩(wěn)定的打入觸發(fā)器；保持時間（Th：hold time）是指數(shù)據(jù)穩(wěn)定后
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2008年7月18日，Altera公布第二季度業(yè)績

  • 　　Altera公司今天宣布第二季度銷售額達到3.599億美元，比2008年第一季度增長7%，比2007年第二季度增長13%。在2008年第一季度0.839億美元凈收入和每股攤薄后收益0.27美元基礎(chǔ)上，第二季度凈收入增長到0.98億美元，每股攤薄后收益0.32美元。和2007年第二季度相比，今年第二季度凈收入增長22%，每股攤薄后收益增長43%。 　　上半年運營現(xiàn)金流為2.268億美元。第二季度，Altera以140萬美元回購其65,000普通股。到目前為止，在第三季度，Altera已經(jīng)以1004萬美
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基于SOPC的視頻采集系統(tǒng)設(shè)計

  • 　　0 引言 　　視頻采集的主流實現(xiàn)方案有兩種：一是基于ASIC，該方案一般采用意法、AMD等公司的專用視頻處理芯片；二是基于DSP，主要采用TI、ADI等公司的DSP信號處理器。它們作為輔處理器，可在主CPU控制下進行視頻信號的采集壓縮。隨著FPGA的發(fā)展，通過SOPC技術(shù)實現(xiàn)視頻采集已成為一種易于開發(fā)、設(shè)計靈活的方案。而這主要得益于IP復用技術(shù)的發(fā)展。在FPGA上構(gòu)建復雜嵌入式系統(tǒng)可利用既有的功能模塊及其驅(qū)動程序。該方案具有更大的集成度和靈活性，因而必將成為電子設(shè)計發(fā)展的一大趨勢。 　　本文介紹了
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基于FPGA電火花加工脈沖電源的設(shè)計

  • 　　0引 言 　　數(shù)控電火花(electrical discharge machining，EDM)機床是一種實現(xiàn)工件精密加工的特種加工工具。早期的電火花成型加工機床的脈沖電源電路是用分立元件組成，或者是用單片機來實現(xiàn)。分立元件電路設(shè)計復雜，電路調(diào)試困難，基于單片機或者是32位的嵌入式CPU的脈沖電源性能有了很大的提高，也具有了很高的智能性，但對于不同的處理器，其移植性不太好，而且如果硬件電路一旦完成就不能進行更改與升級。而采用現(xiàn)場可編程門陣列FPGA在很好的繼承單片機或者是嵌入式CPU設(shè)計的電源的優(yōu)點
  • 關(guān)鍵字： FPGA  脈沖電源  EDM  數(shù)控機床  嵌入式  

利用視頻套件加速FPGA上的視頻開發(fā)

  • 　　隨著下一代視頻壓縮標準問世，行業(yè)從基本視頻處理向更復雜的集成處理解決方案轉(zhuǎn)移，這使得系統(tǒng)的要求超越了獨立DSP力所能及的視頻性能。FPGA以不到30美元的價格提供20GMACs以上的DSP性能，從而為成本敏感型軍事、汽車、醫(yī)療、消費、工業(yè)和安全應用填補了這一空白。只有FPGA能夠為整套端對端視頻解決方案提供邏輯、嵌入式處理、OS支持和驅(qū)動器。 　　妨礙開發(fā)人員將FPGA用于視頻應用的因素并非他們?nèi)狈PGA性能優(yōu)勢的了解，而是缺乏使用其設(shè)計流程的經(jīng)驗，對于那些習慣于用C語言編程的傳統(tǒng)DSP程序開發(fā)
  • 關(guān)鍵字： FPGA  視頻套件  VSK  Simulink  
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