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EEPW首頁 >> 主題列表 >> h．264／mpeg

基于DVB標(biāo)準(zhǔn)的數(shù)字衛(wèi)星電視系統(tǒng)簡介

  • 簡要分析DVB標(biāo)準(zhǔn)的數(shù)字衛(wèi)星電視系統(tǒng)的基本原理,討論了DVB - S系統(tǒng)的信源編碼和信道編碼,并介紹了DVB - S系統(tǒng)的基本結(jié)構(gòu)。
  • 關(guān)鍵字： DVB  MPEG-2  數(shù)字電視  

基于H.264視頻編解碼SoC滿足高清DVR設(shè)計

  • 硬盤錄像機(jī)(DVR)作為監(jiān)控系統(tǒng)的核心部件之一，在10年里高速發(fā)展，從模擬磁帶機(jī)的替代品演變成具有自己獨特價值的專業(yè)監(jiān)控數(shù)字平臺，并被市場廣泛接受。監(jiān)控系統(tǒng)伴隨DVR這些年的發(fā)展向著IP化、智能化發(fā)展.
  • 關(guān)鍵字： H.264  視頻編解碼  SoC  高清DVR設(shè)計  

H.264壓縮算法詳解

  • 原來國際電信標(biāo)準(zhǔn)化部門從1998年就H.26L的H.26S兩個分組，前者研制節(jié)目時間較長的高壓縮編碼技術(shù)，后者則指短節(jié)目標(biāo)準(zhǔn)制訂部門。H.26S 的標(biāo)準(zhǔn)化技術(shù)的名稱為H.263，聽起來很耳生，但實質(zhì)上卻早在用了，還被罵得很激烈。因為，H.263先入為大，一直以MPEG-4大內(nèi)涵的名字在用。 H.263的全稱為MPEG-4 Visual或MPEG-4 Pall Ⅱ，即MPEG-4視頻簡單層面的基礎(chǔ)編碼方式。2001年后，國際電信標(biāo)準(zhǔn)化部門ITU-T和MPEG的上級組織國際標(biāo)準(zhǔn)化組織ISO/國際電氣標(biāo)準(zhǔn)會議I
  • 關(guān)鍵字： H.264  德州儀器  MPEG-4  

FH8735在音視頻壓縮卡上的應(yīng)用

  • 隨著視頻監(jiān)控產(chǎn)品的規(guī)格化，ASIC 方案在成本和穩(wěn)定性方面逐漸顯露出優(yōu)勢，針對音視頻壓縮卡市場適時推出了FH8735 芯片。FH8735能夠支持兩路720P30 高清或者8 路D1 .
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我視頻編碼國家標(biāo)準(zhǔn)AVS與國際標(biāo)準(zhǔn)MPEG的比較

  • 本文從技術(shù)角度對MPEG-2的視頻標(biāo)準(zhǔn)，MPEG-4AVC/H.264和AVS視頻三個視頻標(biāo)準(zhǔn)進(jìn)行對比，包括技術(shù)方案，主觀測食，客觀測試，復(fù)雜度等四個方面。
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H.264中二進(jìn)制化編碼器的FPGA實現(xiàn)

  • 在對H．264標(biāo)準(zhǔn)中二進(jìn)制化部分研究和分析的基礎(chǔ)上，提出其FPGA電路結(jié)構(gòu)，采用并行結(jié)構(gòu)及流水線方式設(shè)計電路。該結(jié)構(gòu)經(jīng)Spartan3 FPGA實現(xiàn)，其吞吐量為每周期1 bit，最大時鐘頻率為100 MHz，能夠滿足H．264中第3級及其以上檔次實時視頻編碼的要求。
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MPEG-2編碼復(fù)用器中的FPGA邏輯設(shè)計

  • MPEG-2編碼復(fù)用器主要由DSP（數(shù)字信號處理器）和FPGA兩大部分組成。其中,DSP作為整個系統(tǒng)的主控單元,而FPGA則完成相應(yīng)的輔助邏輯功能。用FPGA實現(xiàn)的編碼復(fù)用器,具有設(shè)計,升級都非常方便,快速的特點,提高了工作效率。
  • 關(guān)鍵字： MPEG-2編碼FPGA  

基于DSP的數(shù)碼相機(jī)中的MPEG-4 壓縮

  • 雖然數(shù)碼相機(jī) (DSC) 投入市場僅幾年時間，但已經(jīng)使消費(fèi)類電子成像業(yè)發(fā)生了翻天覆地的變化。目前，全球售出的相機(jī)中大約有三分之一是數(shù)碼相機(jī)，而且其份額還在穩(wěn)步上升。
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FPGA與DSP協(xié)同處理系統(tǒng)設(shè)計之：典型實例-整數(shù)DCT變換的設(shè)計與實現(xiàn)

  • 本節(jié)旨在設(shè)計實現(xiàn)了視頻壓縮標(biāo)準(zhǔn)H.264算法中的整數(shù)DCT變換部分，幫助讀者了解并行流水設(shè)計技巧在算法優(yōu)化中的作用。
  • 關(guān)鍵字： DSP  協(xié)同處理  FPGA  整數(shù)DCT變換  H.264  

面向H.264視頻編碼器的SoC驗證平臺

  • 構(gòu)建了面向H.264視頻編碼器的SoC驗證平臺，采用FPGA原型系統(tǒng)完成H.264編碼器驗證。采用Wishbone總線連接32位微處理器OR1200以及其他的必要IP核構(gòu)建基本SoC平臺，并在此基礎(chǔ)上集成H.264硬件編碼模塊；根據(jù)H.264編碼器的數(shù)據(jù)流要求，設(shè)計了逐行輸入/宏塊順序輸出的多端口SDRAM控制器；移植了μC/OSII實時
  • 關(guān)鍵字： H.264  視頻編碼器  SoC驗證平臺  

一種面向H.264視頻編碼器的SoC驗證平臺

  • 構(gòu)建了面向H.264視頻編碼器的SoC驗證平臺，采用FPGA原型系統(tǒng)完成H.264編碼器驗證。采用Wishbone總線連接32位微處理器OR1200以及其他的必要IP核構(gòu)建基本SoC平臺，并在此基礎(chǔ)上集成H.264硬件編碼模塊；根據(jù)H.264編碼器的數(shù)據(jù)流要求，設(shè)計了逐行輸入/宏塊順序輸出的多端口SDRAM控制器；移植了μC/OSII實時
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基于ARM的嵌入式無線視頻監(jiān)控系統(tǒng)

  • 介紹了一種基于ARM9高速嵌入式處理器和H.264高效壓縮算法的嵌入式3G無線視頻監(jiān)控系統(tǒng)。分析了系統(tǒng)的總體結(jié)構(gòu)、硬件結(jié)構(gòu)，并重點闡述了系統(tǒng)軟件的設(shè)計與實現(xiàn)。實驗結(jié)果表明，該系統(tǒng)可以達(dá)到25幀/秒CIF圖像(320×240)，實現(xiàn)了視頻流暢傳輸。
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基于H.264視頻壓縮快速運(yùn)動的估計算法

  • 運(yùn)動估計是整個視頻編碼中運(yùn)算量最大的模塊，可占整個軟件編碼器運(yùn)算量的70%以上。因此視頻系統(tǒng)中編碼器的復(fù)雜部分取決于運(yùn)動估計算法體系結(jié)構(gòu)的復(fù)雜性。
  • 關(guān)鍵字： H.264  視頻壓縮  DCS算法  視頻編碼  運(yùn)動估計  

視頻編碼講壇之H.264前世今生

  • 隨著HDTV等高清資源的興起，H.264這個規(guī)范頻頻出現(xiàn)在我們眼前，HD-DVD和藍(lán)光DVD均計劃采用這一標(biāo)準(zhǔn)進(jìn)行節(jié)目制作。而且自2005年下半年以來，無論是NVIDIA還是ATI都把支持H.264硬件解碼加速作為自己最值得夸耀的視頻技術(shù)。而數(shù)碼播放器領(lǐng)域也吹來了高清和H.264的風(fēng)潮，國內(nèi)外不少數(shù)碼播放器廠商都已經(jīng)開始支持此類編碼的視頻文件，同時網(wǎng)絡(luò)資源的豐富程度也逐漸提升。那H.264到底是何方“神圣”呢？和傳統(tǒng)的RMVB等編碼相比，有什么先進(jìn)之處嗎？
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基于MPEG-4的嵌入式多媒體監(jiān)控系統(tǒng)中壓縮/解壓卡的設(shè)計與實現(xiàn)

  • 本文在簡單分析多媒體監(jiān)控系統(tǒng)發(fā)展現(xiàn)狀的基礎(chǔ)上,提出了一種基于VW2010芯片的多媒體壓縮/ 解壓卡的設(shè)計方案,包括硬件設(shè)計和Linux下設(shè)備驅(qū)動程序設(shè)計。最后在Linux Redhat7.3下編寫了測試程序,并進(jìn)行了全面的測試。
  • 關(guān)鍵字： MPEG  監(jiān)控系統(tǒng)  壓縮  設(shè)備驅(qū)動程序  
共318條 2/22 « 1 2 3 4 5 6 7 8 9 10 » ›|
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