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免費(fèi)的 I/O：改進(jìn) FPGA 時(shí)鐘分配控制

  • 可編程時(shí)鐘器件集成了主要的時(shí)序元件，如一個(gè)PLL、分頻器、扇出緩沖器、零延遲緩沖器，從而節(jié)省電路板面積、降低成本，并提高性能。使用諸如ispClock5400D系列器件，設(shè)計(jì)人員可以更好地規(guī)劃其特定系統(tǒng)的理想時(shí)鐘產(chǎn)生和分配電路，更好地利用其FPGA上的I/O。
  • 關(guān)鍵字： 分配  控制  時(shí)鐘  FPGA  I/O  改進(jìn)  免費(fèi)  

基于NiosⅡ的學(xué)習(xí)型遙控器設(shè)計(jì)

  • 摘要：以Altera FPGA系列Cyclone EPlCl2Q240C8器件為載體，通過SoPC技術(shù)構(gòu)建嵌入式軟核NiosⅡ處理器平臺(tái)，運(yùn)用Verilog HDL硬件描述語(yǔ)言設(shè)計(jì)等精度測(cè)量載波頻率IP核、紅外信號(hào)解調(diào)IP核、紅外編碼脈寬測(cè)量IP核和紅外發(fā)
  • 關(guān)鍵字： FPGA  I／O  電源  仿真  單片機(jī)  

基于C8051F340的非易失大容量數(shù)據(jù)存儲(chǔ)方案

  • 摘要：海洋儀器在后期數(shù)據(jù)分析處理時(shí)數(shù)據(jù)存儲(chǔ)電路是不可或缺的。針對(duì)海洋儀器對(duì)數(shù)據(jù)存儲(chǔ)大容量非易失的要求，結(jié)合實(shí)際工作經(jīng)驗(yàn)，給出幾種擴(kuò)展海量存儲(chǔ)器的方案和實(shí)際電路。這些方案是以C8051F340為主控制器，充分利用
  • 關(guān)鍵字： I／O  數(shù)據(jù)  存儲(chǔ)  

單片機(jī) I/O口使用

  • 一、實(shí)驗(yàn)?zāi)康?br />1、掌握P3口、P1口簡(jiǎn)單使用。
    2、學(xué)習(xí)延時(shí)程序的編寫和使用。
    二、實(shí)驗(yàn)內(nèi)容
    1、實(shí)驗(yàn)原理圖：

    2、實(shí)驗(yàn)內(nèi)容
    （1）P3.3口做輸入口，外接一脈沖，每輸入一個(gè)脈沖，P1口按十六進(jìn)制加1。
    （2）
  • 關(guān)鍵字： 使用  I/O  單片機(jī)  

基于中穎8位MCU的觸摸按鍵方案

  • 前言
    在需要用戶界面的應(yīng)用方案中，傳統(tǒng)的機(jī)電開關(guān)正在被電容式觸摸感應(yīng)控制所替代。
    Sino wealth已經(jīng)開發(fā)了一套觸摸感應(yīng)軟件，使得任意一款8位的中穎微控制器都可以作為一個(gè)電容式觸摸按鍵控制器使
  • 關(guān)鍵字： I/O  MCU  測(cè)量  觸摸感應(yīng)  控制  

基于DSP＋ARM架構(gòu)的協(xié)議轉(zhuǎn)換器設(shè)計(jì)

  • 基于DSP＋ARM架構(gòu)的協(xié)議轉(zhuǎn)換器設(shè)計(jì), 摘要：介紹基于DSP＋ARM架構(gòu)協(xié)議轉(zhuǎn)換器的系統(tǒng)組成及其工作原理，給出了DSP通過EMIF接口與FPGA無(wú)縫連接的接口實(shí)現(xiàn)，DSP通過HPI接口與ARM高速接口的實(shí)現(xiàn)，以及基于ARM的高速以太網(wǎng)接口。簡(jiǎn)要介紹了基于嵌入式操作系
  • 關(guān)鍵字： DSP  ARM  FPGA  I／O  通信  數(shù)據(jù)  

嵌入式系統(tǒng)在鐵路道口報(bào)警系統(tǒng)中的應(yīng)用

  • 嵌入式系統(tǒng)在鐵路道口報(bào)警系統(tǒng)中的應(yīng)用, 摘 要：本文介紹的嵌入式系統(tǒng)在鐵路平交道口自動(dòng)報(bào)警系統(tǒng)中應(yīng)用，采用微軟的WindowsCE操作系統(tǒng),基于PC/104總線的PCM3350主機(jī)和PCM3724硬件平臺(tái)，上位機(jī)采用組態(tài)軟件MCGS所開發(fā)的嵌入版。　　一、 背景　　鐵路平交道
  • 關(guān)鍵字： 顯示屏  A/D  I/O  嵌入式  低功耗  

基于FMC標(biāo)準(zhǔn)的FPGA夾層卡I/O設(shè)計(jì)

  • 基于FMC標(biāo)準(zhǔn)的FPGA夾層卡I/O設(shè)計(jì),　面對(duì)似乎層出不窮的新 I/O 標(biāo)準(zhǔn)，目前嵌入式系統(tǒng)設(shè)計(jì)人員繼續(xù)依靠 FPGA 來部署系統(tǒng)日益重要的外部 I/O 接口，這點(diǎn)絲毫不足為奇。FPGA 可提供大量可配置的 I/O，能在適當(dāng) IP 基礎(chǔ)上支持幾乎無(wú)限多種高度復(fù)雜的 I/O
  • 關(guān)鍵字： I/O  設(shè)計(jì)  夾層  FPGA  FMC  標(biāo)準(zhǔn)  基于  

利用I/O模擬多路復(fù)用器PSoC簡(jiǎn)化傳感器控制設(shè)計(jì)

  • 利用I/O模擬多路復(fù)用器PSoC簡(jiǎn)化傳感器控制設(shè)計(jì),CY8C21times;34可編程系統(tǒng)級(jí)芯片(PSoC)混合信號(hào)陣列具有一個(gè)I/O模擬多路復(fù)用器，由于每個(gè)引腳都可以被用作一個(gè)模擬輸入，因此采用單個(gè)SoC便能夠輕松實(shí)現(xiàn)需要大量不同類型傳感器的控制應(yīng)用。本文介紹了在多種傳感器控
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基于雙CPU在多I/O口系統(tǒng)中的硬件電路設(shè)計(jì)

  • 1 引言 　　常規(guī)的單片機(jī)應(yīng)用系統(tǒng)設(shè)計(jì)，往往都用一個(gè)CPU，再擴(kuò)展一系列外圍輔助電路以達(dá)到相應(yīng)設(shè)計(jì)目標(biāo)。這種方法，尤其在輸入輸出接口較多的系統(tǒng)中，必須進(jìn)行繁瑣的譯碼、邏輯變換，使得系統(tǒng)硬件復(fù)雜，調(diào)試?yán)щy。而
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利用普通I/O口實(shí)現(xiàn)電容觸摸感應(yīng)方案

  • 現(xiàn)在電子產(chǎn)品中，觸摸感應(yīng)技術(shù)日益受到更多關(guān)注和應(yīng)用，不僅美觀耐用，而且較傳統(tǒng)機(jī)械按鍵具有更大的靈敏度、穩(wěn)定性、可靠性，同時(shí)可以大幅提高產(chǎn)品的品質(zhì)。觸摸感應(yīng)解決方案受到越來越多的IC設(shè)計(jì)廠家的關(guān)注，
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Microchip 推出單I/O總線UNI/O EEPROM器件

  • 　　Microchip Technology Inc.(美國(guó)微芯科技公司)今天宣布推出單I/O總線UNI/O EEPROM器件并且開始供貨，除了采用3引腳SOT-23封裝，還提供微型晶圓級(jí)芯片封裝和TO-92封裝。規(guī)格為0.85 mm×1.38 mm的晶圓級(jí)芯片封裝(WLCSP)約為一顆裸片大小，并能支持使用標(biāo)準(zhǔn)拾放機(jī)械的制造流程。長(zhǎng)引線的3引腳TO-92封裝通常用于手工組裝工序制造流程或直接安裝于電纜組件。 　　目前的市場(chǎng)的趨勢(shì)是：與以往型號(hào)相比，消費(fèi)類產(chǎn)品要具備更多的功能，但體積更小
  • 關(guān)鍵字： Microchip  EEPROM  UNI/O  

一種支持I/O的核外中斷執(zhí)行算法

  • 一種支持I/O的核外中斷執(zhí)行算法,通過對(duì)嵌入式實(shí)時(shí)操作系統(tǒng)ARTs-OS的研究，借鑒各種實(shí)時(shí)系統(tǒng)的中斷實(shí)現(xiàn)技術(shù)，提出了一種支持I/O的核外中斷執(zhí)行算法。
  • 關(guān)鍵字： 算法  執(zhí)行  中斷  I/O  支持  

89C51單片機(jī)I/O口模擬串行通信實(shí)現(xiàn)方法

  • 目前普遍采用的MCS51 和PIC 系列單片機(jī)通常只有一個(gè)（或沒有）UART異步串行通信接口，在應(yīng)用系統(tǒng)中若需要多個(gè)串行接口（例如在多機(jī)通信系統(tǒng)中，主機(jī)既要和從機(jī)通信又要和終端通信）的情況下，通常的方法是擴(kuò)展一片82
  • 關(guān)鍵字： 通信  實(shí)現(xiàn)  方法  串行  模擬  單片機(jī)  I/O  89C51  
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