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基于MAX7000系列CPLD的數(shù)據(jù)采集系統(tǒng)
- CPLD是復雜的PLD,專指那些集成規(guī)模大于1000門以上的可編程邏輯器件。它由與陣列、或陣列、輸入緩沖電路...
- 關鍵字: CPLD MAX7000 數(shù)據(jù)采集 FPGA
基于AVR和CPLD的高速數(shù)據(jù)采集系統(tǒng)的設計
- 輸入系統(tǒng)的信息大多數(shù)是模擬量,為使計算機能夠處理這些模擬量,必須經(jīng)由數(shù)據(jù)采集系統(tǒng)將模擬量轉化為數(shù)字量...
- 關鍵字: AVR CPLD 高速數(shù)據(jù)采集
基于VHDL 的矩陣鍵盤及顯示電路設計
- 摘 要:為了有效防止機械式鍵盤按鍵抖動帶來的數(shù)據(jù)錯誤,這里在Quartus Ⅱ開發(fā)環(huán)境下,采用VHDL 語言設計了一種能夠將機械式4 times;4 矩陣鍵盤的按鍵值依次顯示到8 個7 段數(shù)碼管上的矩陣鍵盤及顯示電路。仿真結果表
- 關鍵字: FPGA/ CPLD 鍵盤 電路
基于CPLD內部的反向器實現(xiàn)振蕩器應用
- 摘要:使用CPLD內部的資源施密特觸發(fā)器和反相器,只需外加一個RC就可以設計出一個穩(wěn)定的振蕩器,為CPLD或外圍器件提供時鐘源。靈活方便的設計及低成本的特性,使之具有很好的產品商業(yè)使用價值。 關鍵字:CPLD;施密特觸發(fā)器;振蕩器 前言 電子技術的飛速發(fā)展,尤其是消費類電子產品在成本、產品功能及品質的更高要求,使消費類電子產品的設計不是簡單地要求設計出來,而是要考慮低成本高品質。 CPLD的成本低,占用PCB面積小,功耗低和靈活的后期可編程特性在嵌入式設計中得到越來越廣泛的應用。
- 關鍵字: CPLD 施密特觸發(fā)器 201009
基于AVR和CPLD的高速數(shù)據(jù)采集系統(tǒng)
- 為了提高數(shù)據(jù)采集卡的速度,同時降低成本,設計一種并行數(shù)據(jù)采集系統(tǒng),要求并行采集速度大于10 Mb/s。整個系統(tǒng)由AVR與CPLD控制實現(xiàn),通過MAXl308完成模數(shù)轉換,并設計搭建了其外圍電路。采用12路數(shù)據(jù)存儲模式存儲高速采集的數(shù)據(jù)。實驗依據(jù)存儲要求搭建硬件電路并調試,示波器顯示的波形結果8組脈沖序列完全對齊,沒有出現(xiàn)時序混亂,同時并行處理過程中不相互影響,實現(xiàn)了低成本高速多路采集的設計要求。
- 關鍵字: CPLD AVR 高速數(shù)據(jù) 采集系統(tǒng)
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