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如何采用SystemVerilog來(lái)改善基于FPGA的ASIC原型

ASIC在解決高性能復(fù)雜設(shè)計(jì)概念方面提供了一種解決方案,但是ASIC也是高投資風(fēng)險(xiǎn)的,如90nm ASIC/SoC設(shè)計(jì)大約需要2000萬(wàn)美元開(kāi)發(fā)成本.為了降低成本,現(xiàn)在可采用FPGA來(lái)實(shí)現(xiàn)ASIC.但是,但ASIC集成度較大時(shí),需要幾個(gè)FPGA來(lái)實(shí)現(xiàn),這就需要考慮如何來(lái)連接ASIC設(shè)計(jì)中所有的邏輯區(qū)塊.采用SystemVerilog,可以簡(jiǎn)化這一問(wèn)題.
關(guān)鍵字： SystemVerilog ASIC FPGA

基于FPGA技術(shù)的IDE硬盤接口的設(shè)計(jì)

本文介紹了一種基于FPGA技術(shù)的IDE硬盤接口的設(shè)計(jì)。該卡提供兩個(gè)符合ATA-6規(guī)范的接口，采用FPGA實(shí)現(xiàn)了兩套IDE接口功能，設(shè)計(jì)支持PIO和Ultra DMA傳輸模式，文章側(cè)重于介紹用FPGA實(shí)現(xiàn)IDE接口協(xié)議的具體方法。
關(guān)鍵字：硬盤 IDE接口 FPGA

基于FPGA的視頻傳輸流發(fā)送系統(tǒng)設(shè)計(jì)

在目前的廣播電視系統(tǒng)中ASI接口是使用非常廣泛的一種接口形式，該接口隨同SPI一起被歐洲電信標(biāo)準(zhǔn)化協(xié)會(huì)（ETSI）制訂，以使不同廠家生產(chǎn)的MPEG2單元可以方便地進(jìn)行互聯(lián)。本設(shè)計(jì)方案以FPGA為核心器件，制作出了SPI-ASI接口轉(zhuǎn)換器。這套方案成本較低，利用FPGA的可編程性，硬件的升級(jí)較容易。
關(guān)鍵字：視頻傳輸流編碼模塊 FPGA FIFO模塊

針對(duì)微控制器應(yīng)用的FPGA實(shí)現(xiàn)

當(dāng)你打開(kāi)任何智能電子設(shè)備(從老式的電視遙控器到全球定位系統(tǒng))，會(huì)發(fā)現(xiàn)幾乎所有的設(shè)備都至少采用了一個(gè)微控制器(MCU)，很多設(shè)備里還會(huì)有多個(gè)微控制器。MCU往往被用于專用的終端產(chǎn)品或設(shè)備中，它能夠很好地完成特殊任務(wù)。另一方面，PC的大腦，即微處理器被設(shè)計(jì)用于實(shí)現(xiàn)許多通用的功能。微控制器可用于降低成本，加固工業(yè)和自動(dòng)化應(yīng)用，將其嵌入FPGA中時(shí)，還可以通過(guò)重新編程迅速改變功能。這種靈活性使得單個(gè)設(shè)備可應(yīng)用于接口標(biāo)準(zhǔn)不同的多個(gè)市場(chǎng)。
關(guān)鍵字：微控制器 SRAM FPGA

基于FPGA的高速數(shù)字隔離型串行ADC及其工程應(yīng)用

目前，逆變器在很多領(lǐng)域有著越來(lái)越廣泛地應(yīng)用。對(duì)逆變器的研究具有十分重要的意義和廣闊的工程應(yīng)用前景。常見(jiàn)逆變技術(shù)的控制方法大致分為開(kāi)環(huán)控制的載波調(diào)制方法和閉環(huán)控制的跟蹤控制方法。跟蹤控制方法屬于閉環(huán)控制，閉環(huán)反饋中的檢測(cè)環(huán)節(jié)需要與高壓主電路相互隔離，避免高壓側(cè)電磁噪聲對(duì)控制電路的竄擾。高性能的跟蹤型逆變器對(duì)反饋量的實(shí)時(shí)性要求很高，因此要求反饋環(huán)節(jié)具有高速隔離傳輸模擬信號(hào)的能力。
關(guān)鍵字：數(shù)字隔離型串行ADC FPGA 工程應(yīng)用

基于FPGA的USB側(cè)音測(cè)距信號(hào)發(fā)生器設(shè)計(jì)

隨著我國(guó)航天技術(shù)的不斷進(jìn)步，深空測(cè)距技術(shù)受到越來(lái)越多的關(guān)注。在深空測(cè)距系統(tǒng)中，中頻信號(hào)發(fā)生器對(duì)系統(tǒng)性能有著重要的意義。在USB(統(tǒng)一S頻段)系統(tǒng)中，原有的模擬電路實(shí)現(xiàn)的發(fā)射模塊存在性能不完善、輸入動(dòng)態(tài)范圍小、可控性能差、不能適應(yīng)中心頻率大范圍變化、體積大等問(wèn)題，為了解決上述問(wèn)題，可在一個(gè)標(biāo)準(zhǔn)化通用數(shù)字調(diào)制信號(hào)發(fā)生器的平臺(tái)上，通過(guò)外圍的控制電路，實(shí)現(xiàn)對(duì)載波中心頻率、輸出功率、調(diào)相指數(shù)、測(cè)距音通／斷控制等參數(shù)的改變。
關(guān)鍵字： PLD USB 測(cè)距 D/A FPGA

FPGA系列相關(guān)圖書介紹

FPGA系列相關(guān)圖書介紹
關(guān)鍵字： VHDL FPGA CPLD AltiumDesign XilinxISE

基于FPGA的視頻監(jiān)控系統(tǒng)中多畫面處理器的設(shè)計(jì)

近年來(lái)，隨著視頻監(jiān)控系統(tǒng)在各個(gè)領(lǐng)域的廣泛應(yīng)用，作為視頻監(jiān)近系統(tǒng)組成之一的多畫面處理器的應(yīng)用也愈來(lái)愈普遍。如使用一臺(tái)九畫面處理器，則可在一臺(tái)監(jiān)視器上同時(shí)監(jiān)控9個(gè)目標(biāo)，只需使用一臺(tái)錄像機(jī)便可對(duì)9路視頻信號(hào)同時(shí)實(shí)時(shí)錄像。目前多畫面處理器有黑白/彩色四、九、十六畫面處理器等6種類型。一般說(shuō)來(lái)，多畫面處理器除了有畫面分割功能外，還須有視頻信號(hào)切換及報(bào)警功能。
關(guān)鍵字：處理器 FPGA 多畫面單片機(jī) 視頻監(jiān)控設(shè)計(jì)

可編程邏輯器件設(shè)計(jì)技巧

可編程邏輯器件設(shè)計(jì)技巧
關(guān)鍵字：可編程邏輯器件設(shè)計(jì)技巧 FPGA PLD

FPGA開(kāi)發(fā)板快速教程（二）

PLD是可編程邏輯器件（Programable Logic Device）的簡(jiǎn)稱，F(xiàn)PGA是現(xiàn)場(chǎng)可編程門陣列（Field Programable Gate Array）的簡(jiǎn)稱，兩者的功能基本相同，只是實(shí)現(xiàn)原理略有不同，所以我們有時(shí)可以忽略這兩者的區(qū)別，統(tǒng)稱為可編程邏輯器件或PLD/FPGA。
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基于FPGA滑動(dòng)相關(guān)法偽碼捕獲的實(shí)現(xiàn)

　　對(duì)于碼分多址的擴(kuò)頻通信方式而言，只有當(dāng)接收端本地偽碼與發(fā)端偽碼處于相同相位狀態(tài)時(shí)，有用的信息才能被解出。因此，擴(kuò)頻序列相位的捕獲與跟蹤是擴(kuò)頻通信系統(tǒng)的關(guān)鍵，而偽碼序列相位的捕獲尤為重要。滑動(dòng)相關(guān)法是常用的方法之一。擴(kuò)頻通信系統(tǒng)要求實(shí)時(shí)性，以及較高的數(shù)據(jù)處理速度，這正是FPGA的優(yōu)勢(shì)。所以在擴(kuò)頻通信系統(tǒng)中，大量應(yīng)用FPGA芯片作為前級(jí)處理芯片。
關(guān)鍵字：擴(kuò)頻通信多址 FPGA 滑動(dòng)相關(guān)法

FPGA開(kāi)發(fā)板快速教程（一）

FPGA在復(fù)雜邏輯電路以及數(shù)字信號(hào)處理領(lǐng)域中扮演者越來(lái)越重要的角色，SOC（片上系統(tǒng)）以其低功耗，高性能，低成本，高可靠性等優(yōu)點(diǎn)成為嵌入式系統(tǒng)的發(fā)展趨勢(shì)。作為一個(gè)簡(jiǎn)明的教程，主要宗旨是讓初學(xué)者快速地了解FPGA/SOPC（可編程片上系統(tǒng)）開(kāi)發(fā)的流程。目前IT技術(shù)的發(fā)展可以說(shuō)是一日千里，以本人的觀點(diǎn)來(lái)講，如果希望在電子設(shè)計(jì)領(lǐng)域有所作為，則必須具備快速掌握新技術(shù)的能力。
關(guān)鍵字： SOPC FPGA 快速教程開(kāi)發(fā)板

基于FPGA的數(shù)字式心率計(jì)的設(shè)計(jì)實(shí)現(xiàn)

心率計(jì)是常用的醫(yī)學(xué)檢查設(shè)備，實(shí)時(shí)準(zhǔn)確的心率測(cè)量在病人監(jiān)控、臨床治療及體育競(jìng)賽等方面都有著廣泛的應(yīng)用。心率測(cè)量包括瞬時(shí)心率測(cè)量和平均心率測(cè)量。瞬時(shí)心率不僅能夠反映心率的快慢。同時(shí)能反映心率是否勻齊；平均心率雖只能反映心率的快慢，但記錄方便，因此這兩個(gè)參數(shù)在測(cè)量時(shí)都是必要的。
關(guān)鍵字： VHDL 數(shù)字式 FPGA 心率計(jì) 設(shè)計(jì)

FPGA在無(wú)線網(wǎng)絡(luò)覆蓋優(yōu)化中的應(yīng)用

Altera提供的FPGA具有豐富的邏輯，存儲(chǔ)器，I/O和DSP資源，另外豐富的IP核能夠幫助快速實(shí)現(xiàn)無(wú)線覆蓋優(yōu)化系統(tǒng)。本文主要探討移動(dòng)通信直放站和遠(yuǎn)端射頻單元RRU的特點(diǎn)，以及Altera的FPGA是如何幫助實(shí)現(xiàn)無(wú)線覆蓋優(yōu)化應(yīng)用的。
關(guān)鍵字：無(wú)線網(wǎng)絡(luò) 覆蓋優(yōu)化 FPGA 應(yīng)用

LabVIEW FPGA代碼模塊設(shè)計(jì)（IP核）

對(duì)于利用LabVIEW FPGA實(shí)現(xiàn)RIO目標(biāo)平臺(tái)上的定制硬件的工程師與開(kāi)發(fā)人員，他們可以很容易地利用所推薦的組件設(shè)計(jì)構(gòu)建適合其應(yīng)用的、可復(fù)用且可擴(kuò)展的代碼模塊?；谝呀?jīng)驗(yàn)證的設(shè)計(jì)進(jìn)行代碼模塊開(kāi)發(fā)，將使現(xiàn)有IP在未來(lái)應(yīng)用中得到更好的復(fù)用，也可以使在不同開(kāi)發(fā)人員和內(nèi)部組織之間進(jìn)行共享和交換的代碼更好服用。
關(guān)鍵字： LabVIEW 代碼模塊 FPGA IP核

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xilinx fpga介紹

　　Xilinx FPGA 　　Xilinx FPGA主要分為兩大類，一種側(cè)重低成本應(yīng)用，容量中等，性能可以滿足一般的邏輯設(shè)計(jì)要求，如Spartan系列；還有一種側(cè)重于高性能應(yīng)用，容量大，性能能滿足各類高端應(yīng)用，如Virtex系列，用戶可以根據(jù)自己實(shí)際應(yīng)用要求進(jìn)行選擇。在性能可以滿足的情況下，優(yōu)先選擇低成本器件。　　Xilinx FPGA可編程邏輯解決方案縮短了電子設(shè)備制造商開(kāi)發(fā)產(chǎn)品的時(shí)間 [ 查看詳細(xì) ]