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EEPW首頁 >> 主題列表 >> xilinx-spartan

如何使用腳本對Xilinx FPGA編程

  • 如何使用腳本對Xilinx FPGA編程-最近在做一個GUI的項目，想試著用FPGA實現(xiàn)一個簡單的GUI。硬件基本模塊和整個硬件系統(tǒng)已經(jīng)完成設(shè)計，但是軟件程序上還處在調(diào)試階段，由于程序比較大，F(xiàn)PGA內(nèi)部的BRAM已經(jīng)完全不夠用了，只能將運行的程序放到DDR DRAM中
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7 50T 入門級FPGA評估套件上手評測

  • 7 50T 入門級FPGA評估套件上手評測-FPGA即現(xiàn)場可編程門陣列，屬于可編程邏輯器件的一種。隨著工藝的進步和EDA設(shè)計工具的不斷發(fā)展，F(xiàn)PGA的門檻（學(xué)習(xí)成本和價格成本）也越來越低，目前已經(jīng)成為實現(xiàn)數(shù)字系統(tǒng)的主流平臺之一。
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參考時鐘對SERDES性能的影響

  • 參考時鐘對SERDES性能的影響-我們知道，SERDES對參考時鐘有嚴(yán)格的相位噪聲性能要求。通常，SERDES供應(yīng)商會根據(jù)其SERDES采用的PLL以及CDR架構(gòu)特點，以及性能數(shù)據(jù)，提出對參考時鐘的相位噪聲的具體要求。
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骨灰級音響發(fā)燒友如何打造隨身DAC兼耳擴？

  • 骨灰級音響發(fā)燒友如何打造隨身DAC兼耳擴？-Chord電子產(chǎn)品Hugo，一種專為骨灰級音響發(fā)燒友打造的電池供電的隨身DAC兼耳擴，使用賽靈思 Spartan-6 FPGA.(使用了1/2的單元)實現(xiàn)了一個32位、26K抽頭的WTA插值濾波器，為音樂愛好者創(chuàng)建了通往音樂天堂的階梯。
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詳細(xì)解讀Zynq的三種啟動方式(JTAG,SD,QSPI)

  • 詳細(xì)解讀Zynq的三種啟動方式(JTAG,SD,QSPI)-本文介紹zynq上三種方式啟動文件的生成和注意事項，包括只用片上RAM（OCM）和使用DDR3兩種情況。 JTAG方式 JTAG方式是調(diào)試中最常用的方式，在SDK中 在“Project Explorer”窗口工程上右鍵->Debug As->Debug Configurations可以看到以下窗口 首次打開左邊窗口中Xilinx C/C++ application(GDB)下沒有子項，這時雙擊Xilinx C/C++ application(GD
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FPGA的過去，現(xiàn)在和未來

  • FPGA的過去，現(xiàn)在和未來-自Xilinx在1984年創(chuàng)造出FPGA以來，這種可編程邏輯器件憑借性能、上市時間、成本、穩(wěn)定性和長期維護方面的優(yōu)勢，在通信、醫(yī)療、工控和安防等領(lǐng)域占有一席之地，在過去幾年也有極高的增長率。而進入了最近兩年，由于云計算、高性能計算和人工智能的繁榮，擁有先天優(yōu)勢的FPGA的關(guān)注度更是到達了前所未有的高度。本文從基礎(chǔ)出發(fā)談及FPGA的過去、現(xiàn)在與未來。
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System generator如何與MATLAB進行匹配？

  • System generator如何與MATLAB進行匹配？-system generator是xilinx公司的系統(tǒng)級建模工具，它是擴展mathworks公司的MATLAB下面的simulink平臺，添加了XILINX FPGA專用的一些模塊。加速簡化了FPGA的DSP系統(tǒng)級硬件設(shè)計。
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ZYNQ器件的啟動配置方法

  • ZYNQ器件的啟動配置方法-無任是用CPU作為系統(tǒng)的主要器件，還是用FPGA作為系統(tǒng)的主要器件，系統(tǒng)設(shè)計中首先要考慮到的問題就是處理器的啟動加載問題。
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關(guān)于高阻態(tài)和OOC（out of context）綜合方式

  • 關(guān)于高阻態(tài)和OOC（out of context）綜合方式-Xilinx Vivado工具支持僅將系統(tǒng)設(shè)計的一部分進行綜合，即OOC（out of context）綜合方式。OOC綜合方式的流程就是將設(shè)計的某個模塊單獨完成綜合操作，這會帶來如下可能性
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Xilinx RFSoC開始發(fā)貨，5G與Remote-PHY等應(yīng)用將全面加速

  • 　　RFSoC正式發(fā)貨　　2017年10月9日，All Programmable技術(shù)和器件的全球領(lǐng)先企業(yè)賽靈思公司(Xilinx)宣布其 Zynq UltraScale+ RFSoC 系列開始發(fā)貨，該系列通過一個突破性的架構(gòu)將 RF 信號鏈集成在一個單芯片SoC 中，從而為 5G 無線、有線 Remote-PHY 及其它應(yīng)用的加速實現(xiàn)提供了可能。　　實際上，今年2月Xilinx已經(jīng)預(yù)發(fā)布
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Xilinx宣布集成RF信號鏈的Zynq UltraScale+ RFSoC系列開始發(fā)貨，全面加速5G無線、有線Remote-PHY及其它應(yīng)用

  • 　　All Programmable技術(shù)和器件的全球領(lǐng)先企業(yè)賽靈思公司(Xilinx, Inc.，(NASDAQ:XLNX))今天宣布其Zynq UltraScale+ RFSoC系列開始發(fā)貨，該系列是通過一個突破性的架構(gòu)將RF信號鏈集成在一個單芯片SoC中，致力于加速5G無線、有線Remote-PHY及其它應(yīng)用的實現(xiàn)?；?6nm UltraScale+ MPSoC架構(gòu)的All Programmable RFSoC在單芯片上
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Xilinx、Arm、Cadence和臺積公司共同宣布全球首款采用7納米工藝的CCIX測試芯片

  • 　　賽靈思、Arm、Cadence和臺積公司今日宣布一項合作，將共同構(gòu)建首款基于臺積7納米FinFET工藝的支持芯片間緩存一致性(CCIX)的加速器測試芯片，并計劃在2018年交付。這一測試芯片旨在從硅芯片層面證明CCIX能夠支持多核高性能Arm CPU和FPGA加速器實現(xiàn)一致性互聯(lián)?！　￡P(guān)于CCIX　　出于功耗及空間方面的考慮，在數(shù)據(jù)中心內(nèi)對應(yīng)用進行加速的需求日益增長，諸如大數(shù)據(jù)分析、搜索、機器學(xué)習(xí)、4G/5G無線、內(nèi)存內(nèi)數(shù)據(jù)處理、視頻分析及網(wǎng)絡(luò)處理等應(yīng)用，都已受益于可在多個系統(tǒng)部件中無縫移動
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Xilinx、ARM、Cadence和臺積電構(gòu)建全球首款7納米CCIX測試芯片

  • 　　賽靈思、Arm、Cadence和臺積公司今日宣布一項合作，將共同構(gòu)建首款基于臺積7納米FinFET工藝的支持芯片間緩存一致性(CCIX)的加速器測試芯片，并計劃在2018年交付。這一測試芯片旨在從硅芯片層面證明CCIX能夠支持多核高性能Arm CPU和FPGA加速器實現(xiàn)一致性互聯(lián)。 　　出于功耗及空間方面的考慮，在數(shù)據(jù)中心內(nèi)對應(yīng)用進行加速的需求日益增長，諸如大數(shù)據(jù)分析、搜索、機器學(xué)習(xí)、4G/5G無線、內(nèi)存內(nèi)數(shù)據(jù)處理、視頻分析及網(wǎng)絡(luò)處理等應(yīng)用，都已受益于可在多個系統(tǒng)部件中無縫移動數(shù)據(jù)的加速器引擎。CC
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第二屆全國大學(xué)生智能互聯(lián)創(chuàng)新大賽在重郵落幕

  • 近日，由教育部高等學(xué)校電子信息類專業(yè)教學(xué)指導(dǎo)委員會和中國電子學(xué)會聯(lián)合主辦，arm、Xilinx、ST、ADI、Google等公司協(xié)辦的 2017年第二屆“全國大學(xué)生智能互聯(lián)創(chuàng)新大賽”在重慶郵電大學(xué)舉行了全國總決賽，最終在四個組別的激烈角逐中十六支隊伍獲得了一等獎，三支隊伍贏得了企業(yè)特別獎。第二屆全國大學(xué)生智能互聯(lián)創(chuàng)新大賽從2017年1月份啟動，歷時8個月，共吸引了560余支隊伍參賽。從參數(shù)的隊伍數(shù)量和學(xué)生人數(shù)上均比去年有顯著提升。本次大賽在吸收前一屆比賽的經(jīng)驗基礎(chǔ)上，分成了智能交通、智能醫(yī)療、智能家居、智
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Xilinx 2017 OpenHW設(shè)計大賽及學(xué)術(shù)峰會獅城首秀

  • 　　All Programmable技術(shù)和器件的全球領(lǐng)先企業(yè)賽靈思公司(Xilinx, Inc.)今天在2017年度OpenHW 設(shè)計大賽和學(xué)術(shù)峰會上宣布，此次大會將著重展示賽靈思 All Programmable 技術(shù)面向新加坡智慧城市和智慧校園計劃的優(yōu)勢。這個由賽靈思大學(xué)計劃(XUP)所發(fā)起的競賽和大會系與新加坡科技設(shè)計大學(xué)(SUTD)聯(lián)合主辦，并得到新加坡經(jīng)濟發(fā)展局(EDB)的支持，致力于通過產(chǎn)學(xué)研結(jié)合，共同推動基于賽靈思開放式All&nb
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