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EEPW首頁 >> 主題列表 >> 接收端

PCIe Gen3/Gen4接收端鏈路均衡測試

  • PCIe接口自從被推出以來，已經(jīng)成為了PC和Server上最重要的接口。為了更高了數(shù)據(jù)吞吐率，PCI-SIG組織不斷刷新接口標(biāo)準(zhǔn)，從PCIe?3.0的8GT/s數(shù)據(jù)速率，到PCIe?4.0的16GT/s數(shù)據(jù)速率，再到PCIe?5.0的32GT/x。PCI-SIG組織實現(xiàn)了在速率翻倍的同時，仍能保持使用普通的FR4板材和廉價接插件，主要源自兩個方面的改進(jìn)，一是使用128b/130b編碼來代替8b/10b編碼，使得編碼效率大幅提高；另一個是使用動態(tài)均衡技術(shù)，來代替先前代的靜態(tài)均衡
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基于CORTEX-M3的多機(jī)通信網(wǎng)絡(luò)的設(shè)計與實現(xiàn)

  • 摘要：系統(tǒng)以STM32F103作主控單元，使用RS485通信總線，制定了一套通信協(xié)議，從軟件角度保證了總線仲裁機(jī)制的完整，保證了測控網(wǎng)絡(luò)的正常運(yùn)轉(zhuǎn)。在系統(tǒng)
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無線隨身聽接收端電路

CXA1238M接收端電路圖

  • CXA1238M接收端電路圖如下圖所示，電路中對幾個重要的元件參數(shù)進(jìn)行了說明：
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RF收發(fā)器接收端口差分匹配電路計算方法

  • 0 引言

    接收靈敏度是GSM手機(jī)射頻性能的重要指標(biāo)，匹配電路的調(diào)整是優(yōu)化接收靈敏度的主要方法。常見的GSM手機(jī)射頻接收電路如圖1所示，需要調(diào)整的匹配電路主要有兩部份，一部份是單端匹配電路，是調(diào)整SAWFilte
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USB3.0的物理層接收端的測試方法（二）

  • USB簡介USB(UniversalSerialBus)即通用串行總線，用于把鍵盤、鼠標(biāo)、打印機(jī)、掃描儀、數(shù)碼相機(jī)、MP3、U盤等外圍設(shè)備連接到計算機(jī)，它使計算機(jī)與周邊設(shè)備的接口標(biāo)準(zhǔn)化，從2000年以后，支持USB2.0版本的計算機(jī)和設(shè)備已
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USB3.0的物理層接收端的測試方法(一)

  • USB3.0的Receiver測試的兩種方法由于USB3.0的速率高達(dá)5Gbps，在USB3.0規(guī)范中接收機(jī)測試成為必測項目。接收機(jī)測試包括了誤碼率測試和接收機(jī)抖動容限測試兩部分。對于ReceiverCompliance測試，需要使用誤碼率測試儀BER
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基于FPGA的ADSP-TS101擴(kuò)展USB接口設(shè)計

  • ADI公司的DSP器件(ADSP-TS101)具有浮點實時處理能力強(qiáng)、并行性好等優(yōu)點，從而廣泛被彈載信號處理系統(tǒng)選用。其...
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USB3.0的物理層接收端的測試方法

  • 　　USB3.0的Receiver測試的兩種方法 　　由于USB3.0的速率高達(dá)5Gbps，在USB3.0規(guī)范中接收機(jī)測試成為必測項目。接收機(jī)測試包括了誤碼率測試和接收機(jī)抖動容限測試兩部分。 　　對于Receiver Compliance測試，需要使用誤碼率測試儀BERT(Bit Error Ratio Tester，簡稱BERT)，比如力科的PeRT3。BERT由Pattern Generator和Error Detector組成。如下圖1左圖所示為傳統(tǒng)的BER測試和抖動容限測試的示意圖。BERT的
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飛思卡爾推出汽車遠(yuǎn)程無鑰匙進(jìn)入系統(tǒng)方案

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接收端介紹

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