基于CPLD技術(shù)的看門狗電路設(shè)計
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看門狗電路的設(shè)計
其中，CLKIN為32762Hz方波信號，CLR為分頻器清零端，TIMECLK為32分頻器的輸出端。由該圖可見，當(dāng)CLR為低電平時，分頻器工作，CLR為高電平時，分頻器清零。
3．2 計數(shù)定時電路
該電路是看門狗的核心電路，其功能由圖1中的U5 COMP宏單元來完成，該宏單元由一個8位的二進(jìn)制計數(shù)器、一個8位的寄存器和一個8位的比較器組成。其中8位寄存器的初始值為0FFH，也可通過AD BUS的8位數(shù)據(jù)口和WR DOG片選口進(jìn)行置數(shù)。當(dāng)1024Hz方波進(jìn)入8位計數(shù)器進(jìn)行計數(shù)時，比較器同時會將計數(shù)器的計數(shù)值與寄存器相比較，一旦兩者相等，比較器將產(chǎn)生一個REST高電平，禁止計數(shù)脈沖輸入同時打開復(fù)位電路中的計數(shù)器。仿真波形如圖3所示。
計數(shù)定時電路本文引用地址：http://www.butianyuan.cn/article/190399.htm
其中RESTCLKIN為1024Hz基準(zhǔn)時鐘輸入端。CLR為8位計數(shù)器清零端。WR為8位寄存器的片選鎖存端（上升沿鎖存）。DATA7為8位數(shù)據(jù)總線，用于預(yù)置8位寄存器。REST為復(fù)位輸出端，提供高電平以保證系統(tǒng)復(fù)位。
3．3 復(fù)位延時電路
該電路的功能由U3 DELAY12MS宏單元來完成，目的是在REST信號產(chǎn)生后，使其保持在10ms以上的穩(wěn)定高電平，以保證可以實現(xiàn)系統(tǒng)可靠地復(fù)位，并在延時結(jié)束后產(chǎn)生一個高電平將所有宏單元計數(shù)器清零。仿真波形如圖4所示。
其中，CLKIN為1024Hz基準(zhǔn)時鐘脈沖，當(dāng)U5＿COMP宏單元REST輸出為高電平時被允許輸入U3＿DELAY12MS宏單元。當(dāng)計數(shù)器計為12時，U3＿DELAY12MS宏單元CLRALL端產(chǎn)生一個高電平，通過32768Hz的脈沖鎖存到D型寄存器中，D型寄存器的輸出端將會把所有計數(shù)器清零，使U5＿COMP宏單元中比較器的輸出端為“0”，從而結(jié)束復(fù)位。
4 結(jié)束語
目前，本人在所設(shè)計的產(chǎn)品中都采用了這種設(shè)計，實踐證明，通過CPLD器件來整合看門狗電路，將能有效地保證系統(tǒng)正常工作，同時減小單獨放置看門狗器件帶來的設(shè)計風(fēng)險和額外的費用。
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