基于FPGA的擴頻測距快速捕獲仿真研究
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2．4 判斷模塊
判斷模塊的主要功能是對IFFT后的序列的最大值進(jìn)行判斷，得出其最大值所在的序列號減1就為其碼片差τ。clk為時鐘信號，rest為開始信號，data_in為輸入數(shù)據(jù)，data_out為輸入數(shù)據(jù)data_in中最大值所在的序列號減1。圖6為判斷模塊仿真結(jié)果。本文引用地址：http://www.butianyuan.cn/article/191337.htm
2．5 系統(tǒng)總設(shè)計圖及仿真結(jié)果
本設(shè)計采用自頂向下的設(shè)計方法，利用VHDL語言描述出擴頻測距快速捕獲的各個功能模塊。圖7所示為總體仿真結(jié)果，圖中fft_imag_ outf，fft_real_outf為ifft后的數(shù)據(jù)，data_out為輸出數(shù)據(jù)，由此可見，仿真結(jié)果與設(shè)定的τ=3一樣，驗證了本設(shè)計的可行性。
3 結(jié)束語
采用FFT代替自相關(guān)函數(shù)計算擴頻系統(tǒng)中的碼片偏移可節(jié)省硬件計算時間。經(jīng)過硬件的優(yōu)化設(shè)計與仿真，在Altera Straix II系列FPGA上，時鐘頻率達(dá)到109．1 MHz，捕獲時間和計算時間大約在2μs，捕獲時間提高。此外，由于擴頻技術(shù)可以極大地抑制突發(fā)干擾和脈沖干擾，所以擴頻測距比起傳統(tǒng)的測距方法，如激光測距，超聲測距等方法能適用于更惡劣的環(huán)境，如衛(wèi)星測控，而由于使用快速捕獲技術(shù)，可進(jìn)一步提高實時性，在對測距實時性要求更高的引信技術(shù)中也可以采用。
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