利用FPGA實現(xiàn)HDB3編解碼功能
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3．1．2 V碼和B碼解碼過程
檢測V碼后，根據(jù)HDB3編碼規(guī)則，只需將V碼及之前3位碼全部置零就可同時完成扣V／扣B操作。這又會涉及到一個由現(xiàn)在事件狀態(tài)決定過去事件狀態(tài)的情況，仍可采用兩組4位移位寄存器解決。根據(jù)編碼規(guī)則，V碼是取代連“0”串中的第4個“0”，而B碼總是出現(xiàn)在V碼之前，且只相隔兩個“O”，當輸入是V碼后，只需同時將4位移位寄存器置零，即可同時完成V碼和B碼的解碼過程?？鄢齎碼和B碼后，還需將雙相碼變換成單相碼，即當輸入是“00”時輸出“0”，輸入是“01”時輸出“l(fā)”，至此便完成了HDB3解碼。
3．2 HDB3解碼的Verilog HDL實現(xiàn)
以下利用硬件描述語言實現(xiàn)解碼功能，這里只給出正V碼檢測模塊和扣V碼／扣B碼模塊的關鍵程序。 本文引用地址：http://butianyuan.cn/article/191774.htm
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