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CPLD 在線纜快速測(cè)試技術(shù)中的應(yīng)用

作者: 時(shí)間:2009-03-31 來(lái)源:網(wǎng)絡(luò) 收藏

Fig. 4 The emulation wave of 1#

本文引用地址:http://www.butianyuan.cn/article/192103.htm

由圖4 可知,當(dāng)1#接收到‘Start’命令后,在‘CP’觸發(fā)信號(hào)的作用下,Sign_out 端口依次輸出(00001000)B、(00010000)B、(00100000)B 等信號(hào),實(shí)現(xiàn)了將‘1’進(jìn)行移位且并行輸出。
SST_AND 模塊的仿真波形如圖5 所示,_MCU 的仿真波形如圖6 所示。

Fig. 5 The emulation wave of SST_AND module


Fig. 6 The emulation wave of CPLD_MCU modul


在圖5 中,SS 端的信號(hào)來(lái)自單片機(jī),當(dāng)SS 端的信號(hào)與CPLD1#的CP_out 端信號(hào)皆為高電平時(shí),CPLD2#才可開(kāi)始采集信號(hào)。由圖6 可知,由CPLD1#輸出的8 位并行數(shù)據(jù)(10101101)B 經(jīng)Sign_in 端口進(jìn)入CPLD2# 的 CPLD_MCU 模塊進(jìn)行轉(zhuǎn)換,MISO 端輸出為串行數(shù)據(jù)。
通過(guò)圖 4-圖6 的仿真結(jié)果可知,設(shè)計(jì)的CPLD 接口電路能夠?qū)崿F(xiàn)多條的同時(shí)測(cè)量。本文設(shè)計(jì)的CPLD 接口電路最多能同時(shí)測(cè)量64 條的連通性能(受CPLD芯片I/O 引腳數(shù)量的限制),若要同時(shí)測(cè)試更多,只需更換CPLD 芯片即可。

5.總結(jié)
本文作者創(chuàng)新點(diǎn):利用CPLD 器件I/O 接口多的優(yōu)點(diǎn),創(chuàng)新地將CPLD 引入到線纜中,實(shí)現(xiàn)了多條線纜連通性的同時(shí)測(cè)量。仿真實(shí)驗(yàn)證明設(shè)計(jì)思路正確,方案可行,為高效、準(zhǔn)確地實(shí)現(xiàn)電氣柜線纜組的測(cè)試提供了新的、有效的途徑。

參考文獻(xiàn)
[1] 王玉輝.CPLD技術(shù)在時(shí)差法超聲波流量計(jì)[J].微計(jì)算機(jī)信息.2005, 21(8):117~
119
[2] 葉樹(shù)青.微電腦在自動(dòng)測(cè)試裝置上的應(yīng)用―D28-1線纜測(cè)試儀介紹[J].通信與計(jì)算機(jī).1990,
4:1~5
[3] 杜曉通.智能建筑弱電線纜性能測(cè)試儀[J].電子測(cè)量與儀器學(xué)報(bào).2002,16(2):50~55
[4] 李忠曉.一種簡(jiǎn)易線纜測(cè)試儀[J].有線電視技術(shù).2003,10(22):69~70
[5] 周宏志,王冬青,賈玉蘭.時(shí)域回波反射法在雙絞線測(cè)試[J].電信科學(xué).2004,
20(6):73~75
[6] Mark Zwolinski.Digital System Design with VHDL[M].Beijing: Publishing House of Electronics Industry, 2002
[7] 侯伯亨,顧新.VHDL硬件描述語(yǔ)言與數(shù)字邏輯電路設(shè)計(jì)[M].北京:西安電子科技大學(xué)出版社,2004


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