基于PCI總線多通道數(shù)據(jù)采集系統(tǒng)的設計
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本文原文
CS:片選信號;?
SK:串行時鐘輸入信號，同時也是微處理器與?E?2PROM?之間通信的同步信號，數(shù)據(jù)在他的上升沿鎖定有效;?
DI:數(shù)據(jù)輸入;?
D數(shù)據(jù)輸出。?
PCI9054與E?2PROM的接口設計如圖2所示。?
2.3.2 PCI9054局部總線設計?
由于PCI9054與PCI總線之間實現(xiàn)了無縫連接，系統(tǒng)與計算機接口的大部分信號直接連接即可。PCI9054 Local總線部分信號時序比較復雜，因此用邏輯控制部分來實現(xiàn)PCI9054 Local端的控制。將PCI9054局部數(shù)據(jù)總線高5位數(shù)據(jù)線接到CPLD引腳上，這5根數(shù)據(jù)線可以接收和發(fā)送數(shù)據(jù)，根據(jù)接收到的數(shù)據(jù)對其譯碼產生控制信息，還可以發(fā)出數(shù)據(jù)使PCI9054產生門鈴中斷和MailBox中斷。PCI總線框圖如圖3所示。?
PCI9054局部總線支持50 MHz時鐘，為配合A/D工作，選用40 MHz時鐘。PCI9054的所有地址線和控制信號都只邏輯控制部分連接，產生邏輯控制的工作狀態(tài)和各種控制信息。?
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