FPGA設(shè)計開發(fā)軟件ISE使用技巧之：典型實例-增量式設(shè)計演示

　　6.9 典型實例12：增量式設(shè)計(Incremental Design)演示

　　6.9.1 實例的內(nèi)容及目標

　　1.實例的主要內(nèi)容

　　6.7節(jié)對增量式設(shè)計這一方法的基本概念和流程做了全面的介紹。本節(jié)將以一個具體的實例幫助讀者熟悉增量式設(shè)計的操作流程。

　　本實例的源代碼參見隨書光盤Example6.9。此程序為PC機通過串口向SRAM寫入數(shù)據(jù)，再由FPGA從SRAM中讀取數(shù)據(jù)通過串口將其送到PC機。

　　本實例的重點在于設(shè)計過程中是如何應(yīng)用增量式設(shè)計的，而不是如何實現(xiàn)程序本身的功能。

　　2.實例目標

　　通過本訓練，讀者應(yīng)達到下面的目標。

　　· 掌握增量式設(shè)計與一般設(shè)計的區(qū)別。

　　· 掌握增量式設(shè)計的設(shè)計流程。

　　6.9.2 實例詳解

　　增量式設(shè)計的具體實現(xiàn)步驟如下。

　　(1)打開ISE工程。

　　設(shè)計的第一步為創(chuàng)建邏輯分組。

　　在本設(shè)計中，top.v為頂層模塊。頂層模塊中包含兩個功能模塊，分別為：uart_rs232.v和sram.v。uart_rs232.v用于完成串口數(shù)據(jù)傳輸，sram.v用于對于SRAM的基本讀寫操作。

　　top.v頂層模塊中，僅包含這兩個模塊，沒有其他復(fù)雜邏輯。并且每個邏輯分組均以寄存器輸出，可將這3個模塊看作3個邏輯分組，滿足創(chuàng)建邏輯分組所必須遵循的原則。

　　(2)綜合。

　　為了保證在后面的實現(xiàn)中能夠準確地完成分組區(qū)域約束，這里需要對綜合的屬性進行設(shè)置，在“Processes for Source”中選擇“Synthesize-XST”，單擊鼠標右鍵，設(shè)置綜合屬性如圖6.86所示。

　　圖6.86 設(shè)置綜合屬性對話框

　　選擇“Synthesis Options”/“Keep Hierarchy”，設(shè)置綜合屬性為保留結(jié)構(gòu)層次模式。

　　綜合完畢要查看綜合報告，為了和下面流程中的增量綜合結(jié)果作對比，請?zhí)貏e注意綜合報告中如圖6.87所示的部分。在沒有進行增量綜合時，要對每個模塊都進行綜合和優(yōu)化。

　　圖6.87 未設(shè)置綜合約束條件時的綜合報告

　　(3)設(shè)置管腳約束。

　　在“Processes for Source”中選擇“Assign Package Pins”啟動設(shè)置管腳約束的工具PACE，如圖6.88所示，在Loc處設(shè)置各信號對應(yīng)的FPGA管腳。具體設(shè)置可參見例程代碼Source文件夾下的top.ucf文件。

　　圖6.88 設(shè)置管腳約束界面