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Xilinx Spartan-3A FPGA 的DDR2接口設(shè)計

  • 1 引言DDR2(Double DataRate2)SDRAM是由JEDEC(電子設(shè)備工程聯(lián)合委員會)制定的新生代內(nèi)存技術(shù)標準，它與上一代DDR內(nèi)存技術(shù)標準最大的不同：雖然采用 時鐘的上升／下降沿同時傳輸數(shù)據(jù)的基本方式，但DDR2卻擁有2倍的DDR
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面向Xilinx嵌入式處理器的完整調(diào)試方案

  • FPGA最大的優(yōu)點在于其靈活性，可激發(fā)設(shè)計人員創(chuàng)造出無數(shù)不同的設(shè)計。然而，設(shè)計調(diào)試通常最后才加以考慮——如果還加以考慮的話，因此調(diào)試器通常要適應(yīng)系統(tǒng)的要求。好消息是一家在嵌入式領(lǐng)域耕耘近30年的公
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工程師分析實例，帶你走近Xilinx FPGA設(shè)計

  • 工程師分析實例，帶你走近Xilinx FPGA設(shè)計,一.概述　　本文主要幫助大家熟悉利用ISE進行Xilinx 公司FPGA 代碼開發(fā)的基本流程。主要是幫助初學(xué)者了解和初步掌握 ISE 的使用，不需要 FPGA 的開發(fā)基礎(chǔ)，所以對每個步驟并不進行深入的討論。　　本文介紹的內(nèi)容從新
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FPGA全局時鐘資源相關(guān)Xilinx器件原語及使用

  • FPGA全局時鐘資源相關(guān)Xilinx器件原語及使用,FPGA全局時鐘資源一般使用全銅層工藝實現(xiàn)，并設(shè)計了專用時鐘緩沖與驅(qū)動結(jié)構(gòu)，從而使全局時鐘到達芯片內(nèi)部的所有可配置單元(CLB)、I/O單元(IOB)和選擇性塊RAM(Block Select RAM)的時延和抖動都為最小。為了適應(yīng)復(fù)雜設(shè)
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賽靈思異構(gòu)3D FPGA難在哪兒

  • 不久前，All Programmable技術(shù)和器件的企業(yè)——賽靈思公司（Xilinx）正式發(fā)貨 Virtex-7 H580T FPGA—全球首款3D異構(gòu)All Programmable產(chǎn)品。 Virtex-7 HT采用賽靈思的堆疊硅片互聯(lián) (SSI)技術(shù)，是提供業(yè)界帶寬最高的FPGA，可提供多達16個28 Gbps收發(fā)器和72個13.1 Gbps收發(fā)器，也是能滿足關(guān)鍵Nx100G和400G線路卡應(yīng)用功能要求的單芯片解決方案。 為此，本刊訪問了該公司負責(zé)人，澄
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Xilinx豐富FEC IP核鼎助網(wǎng)絡(luò)運營商降低運營和資本支出

  • All Programmable技術(shù)和器件的全球領(lǐng)先企業(yè)賽靈思公司(Xilinx, Inc. (NASDAQ:XLNX) )在摩納哥格里馬爾迪會議中心舉行的 2012 年 WDM 和下一代光網(wǎng)絡(luò)大會上宣布推出前向糾錯 (FEC) IP 核的延伸系列。該系列產(chǎn)品包括 GFEC、eFEC 和高增益 FEC(xFEC)解決方案，用于控制信號傳輸錯誤，延長傳輸距離，同時減少路線上再生器數(shù)量，從而有助于降低網(wǎng)絡(luò)運營商的運營支出和資本支出。
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第八屆Digilent Design Contest中國區(qū)大賽圓滿結(jié)束

  • 2012年6月9日，第八屆Digilent Design Contest中國區(qū)決選圓滿結(jié)束。本次大賽由上海德致倫電子科技有限公司(Digilent China)主辦，Xilinx大學(xué)計劃部、Cypress大學(xué)計劃部和Microchip大學(xué)計劃部承辦。上海德致倫電子科技有限公司總裁趙峰博士、美國Digilent公司技術(shù)總監(jiān)Josh Pederson、上海理工大學(xué)教授簡獻忠老師、Xilinx資深工程師陸佳華先生和上海德致倫技術(shù)主管姚琪先生出席本次大賽并擔(dān)任評委。
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FPGA教學(xué):應(yīng)用與研究并重

  • 問：您對“第三屆開源硬件及嵌入式大賽”的哪些作品印象較深？ 答：一個就是浙大的“基于FPGA的M2M異構(gòu)虛擬化系統(tǒng)”設(shè)計，一個，還有太原理工大學(xué)?的AVS編碼FPGA實現(xiàn)。 問：這次比賽是否公平公正？ 答：這個評選方式不是特別學(xué)術(shù)性的，有點是大家喜好的程度的海選。 問：就是理論性的東西評選的分值相對占的低了一些？ 答：從最后的結(jié)果來看是這樣的。 問：是否應(yīng)該專家的分數(shù)權(quán)重還要更高一點？ 答：總的來說我覺得名次不是最重要的，
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采用Xilinx 和FPGA的DDR2 SDRAM存儲器接口控制器的設(shè)計

  • 采用Xilinx 和FPGA的DDR2 SDRAM存儲器接口控制器的設(shè)計,本白皮書討論各種存儲器接口控制器設(shè)計所面臨的挑戰(zhàn)和 Xilinx 的解決方案，同時也說明如何使用 Xilinx軟件工具和經(jīng)過硬件驗證的參考設(shè)計來為您自己的應(yīng)用(從低成本的 DDR SDRAM 應(yīng)用到像 667 Mb/sDDR2 SDRAM 這樣的更
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基于FPGA狀態(tài)機的智能手推車多模式控制應(yīng)用

  • 摘要：本設(shè)計采用XILINX Spartan-3E系列FPGA芯片，在基于FPGA(現(xiàn)場可編程門陣列)器件的設(shè)計中，狀態(tài)機是目前應(yīng)用最普遍的設(shè)計方法之一。
  • 關(guān)鍵字： FPGA  XILINX  201205  

基于Xilinx-Spartan6 FPGA的MultiBoot設(shè)計的實現(xiàn)

  • 摘要 介紹了Multibool的兩種實現(xiàn)方法。通過Xilinx Spartan-6 FPGA的Multiboot特性，允許用戶一次將多個配置文件下載入Flash中，根據(jù)不同時刻的需求，在不掉電重啟的情況下，從中選擇一個來重配置FPGA，實現(xiàn)不同功能，
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基于FPGA的具有流量控制機制的高速串行數(shù)據(jù)傳輸系統(tǒng)設(shè)計

  • 摘要：本文介紹了基于Xilinx Virtex-6 FPGA的高速串行數(shù)據(jù)傳輸系統(tǒng)的設(shè)計與實現(xiàn)，系統(tǒng)包含AXI DMA和GTX串行收發(fā)器，系統(tǒng)增加了流量控制機制來保證高速數(shù)據(jù)傳輸?shù)目煽啃?。最后進行了仿真測試，測試結(jié)果顯示系統(tǒng)可以高速可靠地傳輸數(shù)據(jù)。
  • 關(guān)鍵字： Xilinx  數(shù)據(jù)傳輸  DMA  201204  

XUP-Digilent TTP第二、三期培訓(xùn)成功舉辦

  • XUP(Xilinx大學(xué)計劃部)攜手Digilent China(上海德致倫)舉辦TTP(Target Teaching Platform)課程培訓(xùn)。第二、三期培訓(xùn)于4月7日、4月8日成功舉辦。
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基于Xilinx軟件的FPGA系統(tǒng)設(shè)計方法介紹

  • 基于Xilinx軟件的FPGA系統(tǒng)設(shè)計方法介紹,Solution:在對FPGA設(shè)計進行最初步的系統(tǒng)規(guī)劃的時候，需要進行模塊劃分，模塊接口定義等工作。通常，我們只能在紙上進行設(shè)計。雖然在紙上我們可以很隨意地書寫，而用紙畫的不方便就在于，如果對某一個模塊進行較大改動
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Xilinx FPGA開發(fā)環(huán)境的安裝方法

  • Xilinx FPGA開發(fā)環(huán)境的安裝方法,一、計算機硬件環(huán)境要求：
    1、操作系統(tǒng)：
    Microsoft Windows XP Home Edition SP2
    2、基本配置：
    A、處理器：Intel CPU T2050 1.6GHz
    B、內(nèi)存：512MB
    C、硬盤：60GB(其中軟件安裝的空問需要3GB)補充
  • 關(guān)鍵字： 安裝  方法  環(huán)境  開發(fā)  FPGA  Xilinx  
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