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Cadence與中芯國(guó)際推出射頻工藝設(shè)計(jì)工具包

• Cadence設(shè)計(jì)系統(tǒng)公司和中芯國(guó)際，共同宣布，一個(gè)支持射頻設(shè)計(jì)方案的新的0.18微米SMIC CMOS射頻工藝設(shè)計(jì)工具包將正式投入使用。 新的0.18微米SMIC CMOS射頻工藝設(shè)計(jì)工具包(PDK)已成功通過(guò)驗(yàn)證，正式進(jìn)入中國(guó)射頻集成電路設(shè)計(jì)市場(chǎng)。其驗(yàn)證包括代表性設(shè)計(jì)IP的硅交互作用測(cè)試，如PLLs，集中于仿真結(jié)果和快速設(shè)計(jì)寄生。 新方案使中國(guó)無(wú)線芯片設(shè)計(jì)者可得到必要的設(shè)計(jì)軟件和方法學(xué)，以達(dá)到確保符合設(shè)計(jì)意圖的集成電路表現(xiàn),可縮短并準(zhǔn)確的預(yù)測(cè)設(shè)計(jì)周期。作為合作方，為了普遍推廣，Ca
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