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基于FPGA的LVDS高速差分板間接口應(yīng)用

• 隨著ADC器件速率的提高以及FPGA、DSP器件運算速度的提升，高速AD和信號處理系統(tǒng)之間需要進行高速、穩(wěn)定的數(shù)據(jù)傳輸，原來廣泛應(yīng)用CPCI以及FDPD高速總線的帶寬已經(jīng)無法滿足寬帶接收機的數(shù)據(jù)傳輸速率要求，成為影響接收機性能的新瓶頸。針對這一情況，提出了一種基于LVDS差分接口的DDR傳輸接口，解決了這一瓶頸，并且在實際硬件平臺上進行了FPGA實現(xiàn)，達到了18．4 Gbit／s的接口速率。
  
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