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基于FPGA的IPV6數(shù)據(jù)包的拆裝實(shí)現(xiàn)

• 基于FPGA的IPV6數(shù)據(jù)包的拆裝實(shí)現(xiàn) 王志遠(yuǎn), 杜詩(shī)武, 曲 晶(信息工程學(xué)院 信息技術(shù)研究所,河南 鄭州 450002)  　　摘　要：介紹了一種運(yùn)用FPGA將IPV6數(shù)據(jù)包的包頭和數(shù)據(jù)部分分離并重新封裝的方法。利用該方法,可以使IPV6數(shù)據(jù)包的拆裝處理速度達(dá)到2Gbit/s以上。 　　關(guān)鍵詞：FPGA IPV6數(shù)據(jù)包 拆裝 FIFO 　　筆者在參與國(guó)家“863”重大專(zhuān)題項(xiàng)目“高速密碼芯片及驗(yàn)證平臺(tái)系統(tǒng)”的過(guò)程中,遇到了將IPV6數(shù)據(jù)包的包頭和數(shù)據(jù)部分拆開(kāi),然后把數(shù)據(jù)部分送密碼芯片進(jìn)行加
• 關(guān)鍵字： FIFO  FPGA  IPV6數(shù)據(jù)包  拆裝