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流水線相位累加器 文章 進入流水線相位累加器技術社區(qū)

基于FPGA的流水線結構DDS多功能信號發(fā)生器的設計與實現(xiàn)

  • 在應用FPGA進行DDS系統(tǒng)設計過程中，選擇芯片的運行速度優(yōu)化和資源利用優(yōu)化常常是相互矛盾的，從發(fā)展趨勢和運算要求看，系統(tǒng)速度指標的意義比面積指標更趨重要?；诖耍榻B了一種流水線結構來優(yōu)化傳統(tǒng)的相位累加器，在QuartusⅡ開發(fā)環(huán)境下搭建系統(tǒng)模型、仿真及下載，并采用嵌入式邏輯分析儀分析和驗證了實驗結果。該系統(tǒng)可以完成多位頻率控制字的累加，能夠產(chǎn)生正弦波、方波和三角波，具有良好的實時性。
  • 關鍵字： 流水線相位累加器  DDS  FPGA  
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流水線相位累加器介紹

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