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EEPW首頁 >> 主題列表 >> 流水線

一個用于流水線模數(shù)轉(zhuǎn)換器的高精度、低功耗采樣保

  • 介紹了一個用于高精度模數(shù)轉(zhuǎn)換器，采用0.25μmCMOS工藝的高性能采樣保持電路。該采樣保持電路的采樣頻率為20MHz，允許最大采樣信號頻率為10MHz，在電源電壓為2.5V的情況下，采樣信號全差分幅度為2V。通過采用全差分flip-around結構，而非傳統(tǒng)的電荷傳輸構架，因而在同等精度下，大大降低了功耗。為了提高信噪比，采用自舉開關。Hspice仿真結構顯示：在輸入信號為5MHz的情況下，無雜散動態(tài)范圍(SFDR)為92.4dB.該電路將被用于一個14位20MHz流水線模數(shù)轉(zhuǎn)換器。
  • 關鍵字： 流水線  高精度  低功耗  采樣保持電路    

可重構平臺下AES算法的流水線性能優(yōu)化

  • 摘要 AES-Rijndael算法是美國取代DES的新一代分組加密算法標準，也是事實上的國際標準。本文在可重構平臺上針對 128位密鑰長度AES算法的流水線性能優(yōu)化技術進行了研究，通過對基本運算優(yōu)化、循環(huán)展開、輪內(nèi)流水線、輪
  • 關鍵字： 性能  優(yōu)化  流水線  算法  平臺  AES  重構  

一種基于流水線的SpaceWire路由器研究

一種基于FPGA并行流水線的FIR濾波器設計方案

  • 1 Fir濾波器原理
    有限沖激響應(FIR)數(shù)字濾波器和無限沖激響應(IIR)數(shù)字濾波器廣泛應用于數(shù)字信號處理系統(tǒng)中。IIR數(shù)字濾波器方便簡單，但它相位的非線性，要求采用全通網(wǎng)絡進行相位校正，且穩(wěn)定性難以保障。FIR濾
  • 關鍵字： FPGA  FIR  并行  流水線    

流水線ADC中高速比較器的設計和分析

  • 1、前言　　在任何一個高速高分辨率的模數(shù)轉(zhuǎn)換器中，高精度和快速比較器總是起著至關重要的作用。與其它種類的ADC相比，流水線ADC 有著高速、高分辨率的特點。因此，它在電子系統(tǒng)中，有著廣泛的應用。流水線ADC由許多
  • 關鍵字： ADC  流水線  比較器  分析    

8位微控制器體系架構的設計研究

  • 　　摘  要: 本文分析了目前8位微控制器的更新和設計趨勢，主要討論其RISC體系架構的產(chǎn)品設計，并重點從體系架構的角度出發(fā)，就高性能、低功耗兩方面對在設計中采用的關鍵技術進行了探討研究。  　　關鍵詞： RISC；微控制器；低功耗；流水線  　　1．引言 　　微控制器(Microcontroller)自上世紀70年代出現(xiàn)以來，在將近30年的時間里得到了迅猛的發(fā)展和廣泛的應用。隨著微電子技術的飛速發(fā)展，微控制器以其性能好、體積小、價格優(yōu)、功能齊全等突出優(yōu)點被廣泛應用于家
  • 關鍵字： 微控制器  RISC  低功耗  流水線  MCU  

AD1672 單片12位模數(shù)轉(zhuǎn)換器的原理及其應用

  • 　　摘 要： ad1672是美國adi公司最近推出的一種新器件，它采用4級流水線閃爍式模數(shù)轉(zhuǎn)換結構，單電源工作，12位分辨率，3msps采樣速率，非常適用于通信、圖象處理和醫(yī)療設備新電路設計。 　　關鍵詞：閃爍式模數(shù)轉(zhuǎn)換器 流水線 不失碼 超量程 　　一、 概述 ad1672是美國adi公司最近推向市場的一種新型單片式模數(shù)轉(zhuǎn)換器(adc)。片上含有4個高性能采樣保持放大器(sha)和4個閃爍式adc及電壓基準。它采用4級流水線結構，輸出帶有誤差修正邏輯電路，并采用bicmos工藝，從而保證在3msps
  • 關鍵字： 閃爍式模數(shù)轉(zhuǎn)換器  流水線  不失碼  MCU和嵌入式微處理器  

32位嵌入式CPU中系統(tǒng)控制協(xié)處理器的設計

  • 摘  要：系統(tǒng)控制協(xié)處理器是MIPS體系結構CPU中必需的一個單元模塊。它最主要的功能就是利用一系列特權寄存器記錄當前CPU所處的狀態(tài)，負責異常/中斷處理，提供指令正常執(zhí)行所需的環(huán)境。本文論述了一個實現(xiàn)MIPS 4Kc指令集CPU中系統(tǒng)控制協(xié)處理器的設計，包括對特權寄存器寫操作的實現(xiàn)，精確異常處理機制和全定制后端物理設計。關鍵詞：系統(tǒng)控制協(xié)處理器；精確異常處理；流水線；全定制     MIPS體系結構中的系統(tǒng)控制協(xié)處理器簡稱CP0，它提供指令正常執(zhí)行所需的環(huán)境，進
  • 關鍵字： 嵌入式系統(tǒng)  單片機  系統(tǒng)控制協(xié)處理器  精確異常處理  流水線  嵌入式  

一種高速并行FFT處理器的VLSI結構設計

  • 萬紅星　陳 禾　韓月秋 (北京理工大學 電子工程系信號與信息處理專業(yè),北京 100081)  　　摘　要：在OFDM系統(tǒng)的實現(xiàn)中,高速FFT處理器是關鍵。在分析了基4按時域抽取快速傅立葉變換(FFT)算法特點的基礎上,研究了一種高性能FFT處理器的硬件結構。此結構能同時從四個并行存儲器中讀取蝶形運算所需的4個操作數(shù),極大地提高了處理速度。此結構控制單元簡單,便于模塊化設計。經(jīng)硬件驗證,達到設計要求。在系統(tǒng)時鐘為100MHz時,1024點18位復數(shù)FFT的計算時間為13µs。 　　關鍵
  • 關鍵字： FFT  蝶形單元  塊浮點  流水線  

一種基于功耗管理的DSP處理器設計

  • 摘　要：一種具有功耗管理特性的DSP處理器的結構設計。該處理器采用4級流水線和增強型的哈佛并行系統(tǒng)結構及完善的時鐘管理模塊,提供了一種DSP處理器的集成設 　　關鍵詞：DSP處理器 流水線 哈佛結構 低功耗 　　在信息日益成為一種重要資源的今天,強大的市場需求和微電子技術的發(fā)展促成了便攜式電子系統(tǒng)的飛速發(fā)展。這些便攜式電子設備,不但對速度和面積要求非常高,而且對系統(tǒng)的平均功耗要求也很嚴格,使功耗問題日漸成為制約便攜式電子設備發(fā)展的瓶頸。要獲得高性能低功耗的方案,其實質(zhì)也就是在處理速度、芯片面積和功耗上
  • 關鍵字： DSP處理器  低功耗  哈佛結構  流水線  

DDS邏輯優(yōu)化設計及Verilog實現(xiàn)

  • 摘    要：本文主要介紹了在DDS系統(tǒng)中，為了提高芯片運算速度，加大輸出帶寬，減小芯片規(guī)模從而提高可靠性和頻譜純度而采用的優(yōu)化方法及其VerilogHDL實現(xiàn)。關鍵詞：流水線；輸入寄存器結構；加法器最低位修正；壓縮存儲查找表 概述由于DDS頻率合成方法具有低頻率轉(zhuǎn)換時間、低失真輸出波形、高分辨率、高頻譜純度、可編程和寬頻率輸出范圍等優(yōu)良性能，在現(xiàn)代頻率合成領域中具有越來越重要的地位。在許多應用領域中，如通信、導航、雷達和電子對抗等， DDS頻率源都是主流的關鍵部件。 D
  • 關鍵字： 加法器最低位修正  流水線  輸入寄存器結構  壓縮存儲查找表  

TMS320C55x的指令流水線及其效率的提高

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