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EEPW首頁 >> 主題列表 >> 浮點(diǎn)

高性能汽車和FPGA？――共同點(diǎn)比您想象得多

  • 上世紀(jì)60年代以及70年代早期被認(rèn)為是ldquo;肌肉車rdquo;時(shí)代。這是從中端汽車設(shè)計(jì)采用大型發(fā)動(dòng)機(jī)開始的。最著名的例子包括Chevelles、Fairlanes、G
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具有浮點(diǎn)單元的32位AVR微控制器系列

  • 愛特梅爾公司(Atmelreg; Corporation)在德國慕尼黑Electronica 2010展會(huì)上宣布推出首個(gè)帶有浮點(diǎn)單元(floating point unit, FPU)的32位AVRreg;微控制
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基于Altera浮點(diǎn)IP核實(shí)現(xiàn)浮點(diǎn)矩陣相乘運(yùn)算的改進(jìn)設(shè)計(jì)

  • 嵌入式計(jì)算作為新一代計(jì)算系統(tǒng)的高效運(yùn)行方式，應(yīng)用于多個(gè)高性能領(lǐng)域，如陣列信號處理、核武器模擬、計(jì)算流體動(dòng)力學(xué)等。在這些科學(xué)計(jì)算中，需要大量的浮點(diǎn)矩陣運(yùn)算。而目前已實(shí)現(xiàn)的浮點(diǎn)矩陣運(yùn)算是直接使用VHDL語言編
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基于Virtex-5的經(jīng)典設(shè)計(jì)匯總，包括無線基站、LTE仿真器、浮點(diǎn)接口等

  • 　　Virtex是Xilinx FPGA中的高端產(chǎn)品，占據(jù)著全球高端產(chǎn)品的大部分市場，從Virtex-II開始，這一系列產(chǎn)品不斷升級和更新，性能也越來越卓越。本文為您介紹基于Virtex-5進(jìn)行的設(shè)計(jì)匯總。 　　基于Virtex-5平臺的真隨機(jī)數(shù)發(fā)生器的設(shè)計(jì)實(shí)現(xiàn) 　　本文嘗試了一種用純數(shù)字電路實(shí)現(xiàn)的TRNG結(jié)構(gòu)，且不使用諸如PLL等特殊資源，便于設(shè)計(jì)由FPGA驗(yàn)證移植到芯片設(shè)計(jì)。其核心思想是使用反相器和延時(shí)單元構(gòu)成兩個(gè)相互獨(dú)立的振蕩器，由于內(nèi)部噪聲的差異引起的相位偏移作為熵源，經(jīng)過一段時(shí)間振蕩后，隨機(jī)
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ST新款STM32F3浮點(diǎn)數(shù)字信號控制器面世，售價(jià)低于一美元

  • 　　意法半導(dǎo)體宣布其新款的STM32F301/302/303系列微控制器已經(jīng)量產(chǎn)，并可通過經(jīng)銷渠道訂貨?；诩筛↑c(diǎn)單元(FPU)的ARM?Cortex?-M4內(nèi)核，新產(chǎn)品具有出色的處理性能和系統(tǒng)芯片的集成度，針對注重價(jià)值的先進(jìn)應(yīng)用?！　∽鳛槭袌錾鲜讉€(gè)低于1美元并實(shí)現(xiàn)量產(chǎn)、集成FPU的Cortex-M4微控制器， 新的STM32F301基本型微控制器集成32KB-64KB片上閃存和16KB SRAM，讓客戶輕松邁入ARM?Cortex?-M4微控制器應(yīng)用開發(fā)行列。STM32F302和S
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基于Altera浮點(diǎn)IP核實(shí)現(xiàn)浮點(diǎn)矩陣相乘運(yùn)算的改進(jìn)設(shè)

  • 嵌入式計(jì)算作為新一代計(jì)算系統(tǒng)的高效運(yùn)行方式，應(yīng)用于多個(gè)高性能領(lǐng)域，如陣列信號處理、核武器模擬、計(jì)算流體動(dòng)力學(xué)等。在這些科學(xué)計(jì)算中，需要大量的浮點(diǎn)矩陣運(yùn)算。而目前已實(shí)現(xiàn)的浮點(diǎn)矩陣運(yùn)算是直接使用VHDL語言編
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有著低功耗,浮點(diǎn)處理精度的SHARC 2147x系列處理器

  • 有著低功耗,浮點(diǎn)處理精度的SHARC 2147x系列處理器,前言如今便攜式和/或電池供電的系統(tǒng)設(shè)計(jì)師已經(jīng)大大受益于體積不斷減小、性能卻不斷提高的數(shù)字處理器(DSP)，他們能夠前所未有地在不斷減小的體積內(nèi)更好地實(shí)現(xiàn)高端系統(tǒng)功能。但是還是有些問題得不到解決，設(shè)計(jì)師仍然面
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一種浮點(diǎn)反正切函數(shù)的FPGA設(shè)計(jì)和實(shí)現(xiàn)

  • 快速精確的反正弦函數(shù)運(yùn)算在現(xiàn)代工程中應(yīng)用廣泛。為了提高反正弦函數(shù)的精度和計(jì)算能力， 研究了基于CORD IC算法的反正弦函數(shù)運(yùn)算器的FPGA 實(shí)現(xiàn)， 并通過改進(jìn)算法減小了誤差， 使誤差精度達(dá)到10--4 數(shù)量級。并在X ili
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基于FPGA的高速流水線浮點(diǎn)乘法器設(shè)計(jì)與實(shí)現(xiàn)

  • 1 引言　　在數(shù)字化飛速發(fā)展的今天，人們對微處理器的性能要求也越來越高。作為衡量微處理器 性能的主要標(biāo)準(zhǔn)，主頻和乘法器運(yùn)行一次乘法的周期息息相關(guān)。因此，為了進(jìn)一步提高微處 理器性能，開發(fā)高速高精度的乘法器
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浮點(diǎn)模型的定點(diǎn)化到產(chǎn)品級代碼的生成

  • 浮點(diǎn)模型的定點(diǎn)化到產(chǎn)品級代碼的生成,浮點(diǎn)轉(zhuǎn)換為定點(diǎn)是嵌入式軟件開發(fā)中的一個(gè)重要步驟，這項(xiàng)工作非常繁瑣，需要大量人力并且容易產(chǎn)生錯(cuò)誤。用浮點(diǎn)數(shù)學(xué)設(shè)計(jì)的算法表示理想的算法行為，經(jīng)常必須轉(zhuǎn)換為定點(diǎn)數(shù)學(xué)，才能用于更加經(jīng)濟(jì)的、只支持整數(shù)的大規(guī)模生
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浮點(diǎn)LMS算法的FPGA實(shí)現(xiàn)

  • 浮點(diǎn)LMS算法的FPGA實(shí)現(xiàn),引言
    　　LMS(最小均方)算法因其收斂速度快及算法實(shí)現(xiàn)簡單等特點(diǎn)在自適應(yīng)濾波器、自適應(yīng)天線陣技術(shù)等領(lǐng)域得到了十分廣泛的應(yīng)用。為了發(fā)揮算法的最佳性能，必須采用具有大動(dòng)態(tài)范圍及運(yùn)算精度的浮點(diǎn)運(yùn)算，而浮點(diǎn)運(yùn)算的
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什么叫浮點(diǎn)運(yùn)算

  • 什么叫浮點(diǎn)運(yùn)算當(dāng)我們用不同的電腦計(jì)算圓周率時(shí)，會(huì)發(fā)現(xiàn)一臺電腦的計(jì)算較另一臺來講結(jié)果更加精確?；蛘呶覀?...
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具有硬件矢量浮點(diǎn)運(yùn)算單元的MCU在醫(yī)療電子中的應(yīng)用

  • 具有硬件矢量浮點(diǎn)運(yùn)算單元的MCU在醫(yī)療電子中的應(yīng)用,本文給出了量化的科學(xué)測試方法以幫助嵌入式工程師考慮如何選擇適合于特定應(yīng)用的控制器來構(gòu)建系統(tǒng)。即使所測試的嵌入式系統(tǒng)差異很大，確鑿的數(shù)據(jù)仍可以幫助系統(tǒng)評估者比較相同的性能特征。
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電力系統(tǒng)中多通道同步采樣ADC（AD7606）與浮點(diǎn)DSP（ADSP-21479）通信的設(shè)計(jì)與實(shí)現(xiàn)

參數(shù)化可配置IP核浮點(diǎn)運(yùn)算器的設(shè)計(jì)與實(shí)現(xiàn)

  • 參數(shù)化可配置IP核浮點(diǎn)運(yùn)算器的設(shè)計(jì)與實(shí)現(xiàn),將參數(shù)化可配置IP核的設(shè)計(jì)方法引入到浮點(diǎn)運(yùn)算器設(shè)計(jì)中，通過設(shè)計(jì)時(shí)提取的可用參數(shù)，將浮點(diǎn)運(yùn)算器設(shè)計(jì)成為參數(shù)化、可配置、可重用的IP核。通過仿真驗(yàn)證了實(shí)現(xiàn)參數(shù)化IP核浮點(diǎn)運(yùn)算器的可行性和有效性。
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浮點(diǎn)介紹

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