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硅設(shè)計鏈廠商通力合作 降低90納米芯片總功耗

  •     3月21日,硅設(shè)計鏈產(chǎn)業(yè)協(xié)作組織(Silicon Design Chain Initiative)的半導(dǎo)體工業(yè)領(lǐng)導(dǎo)廠商宣布,經(jīng)流片驗證的低功耗90納米芯片設(shè)計技術(shù)可使芯片的總功耗降低40%。     該低功耗設(shè)計采用了多個廠商的先進技術(shù):ARM1136JF-S™測試芯片,ARM® Artisan®標準設(shè)計單元庫和存儲單元,Cadence Encounter
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硅設(shè)計介紹

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