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基于Nios的DDS高精度信號源實現(xiàn)

FPGA系統(tǒng)設計實戰(zhàn)經(jīng)驗分享FPGA系統(tǒng)設計實戰(zhàn)經(jīng)驗分享

FPGA基礎(chǔ)入門

面向超低功耗設計的微控制器功效優(yōu)化方案

基于FPGA的嵌入式以太網(wǎng)與Matlab通信系統(tǒng)設計

  • 0引言近年來，隨著信息技術(shù)的發(fā)展，網(wǎng)絡化日加普遍，以太網(wǎng)被廣泛應用到各個領(lǐng)域。例如在數(shù)據(jù)采集領(lǐng)域，一些小型...
  • 關(guān)鍵字： FPGA  IP  嵌入式  PLD  CPLD  SoC  數(shù)字信號處理  消費電子  FPGA  

基于PCI接口芯片外擴FIFO的FPGA實現(xiàn)

基于FPGA的MIII總線與RS422通信協(xié)議轉(zhuǎn)換板的設計

FPGA設計工具淺談

FPGA硬件電路的調(diào)試

一種實用光端機的設計與實現(xiàn)

  • 摘要：提出了一種簡易的實用光端機的設計方法，能夠完成TTL／E1、RS232、RS422 3類信號經(jīng)光纖傳送，很好地實現(xiàn)了中短距離的點對點通信。TTL／E1信號直接送給通道選擇。RS232和RS422分別經(jīng)過相應的信號調(diào)理變?yōu)門IL電
  • 關(guān)鍵字： PLD  光電轉(zhuǎn)換  LED  信號  通信  

萊迪思推出新的MachXO2 PLD系列

  • 　　萊迪思半導體公司今天宣布推出其新的MachXO2? PLD系列，為低密度PLD的設計人員提供了在單個器件中前所未有的低成本，低功耗和高系統(tǒng)集成。嵌入式閃存技術(shù)采用了低功耗65納米工藝，與MachXO? PLD系列相比，MachXO2系列提供了3倍的邏輯密度、10倍的嵌入式存儲器、降低了100倍以上的靜態(tài)功耗并減少了高達30%的成本。
  • 關(guān)鍵字： 萊迪思  PLD  

PLD設計方法及步驟

  • 1、PLD器件的設計步驟 　　1.電路邏輯功能描述　　PLD器件的邏輯功能描述一般分為原理圖描述和硬件描述語言描述，原理圖描述是一種直觀簡便的方法，它可以將現(xiàn)有的小規(guī)模集成電路實現(xiàn)的功能直接用PLD器件來實現(xiàn)，而不
  • 關(guān)鍵字： PLD  設計方法    

基于MachXO設計的PLD控制開發(fā)技術(shù)

  • 基于MachXO設計的PLD控制開發(fā)技術(shù),MachXO PLD是非易失的可以無限次重新配置的可編邏輯器件PLD），具有256-2280個查找表（LUT），73-271個I/O，多達27.6Kb sysMEM嵌入?yún)^(qū)塊RAM，多達7.7Kb分布式RAM，可編程的sysIOtrade;緩沖器支持LVCMOS 3.3/2.5/1.8/
  • 關(guān)鍵字： 控制  開發(fā)技術(shù)  PLD  設計  MachXO  基于  

用VHDL實現(xiàn)的有線電視機頂盒信源發(fā)生方案

  • VHDL是隨著可編輯邏輯器件（PLD）的發(fā)展而發(fā)展起來的一種硬件描述語言。它是1980年美國國防部VHSIC（超高速集...
  • 關(guān)鍵字： PLD  VHDL  機頂盒  信源  

用PLD簡化邊界掃描測試

  • 　　引言 　　隨著JTAG標準IEEE1149.1的定型，及隨后開始在集成電路Intel 80486中采用，邊界掃描測試已被廣泛應用于測試印刷電路板的連接，以及在集成電路內(nèi)進行測試。邊界掃描測試受到設計人員的歡迎，因為它能夠在線測試，而無需昂貴的釘床在線測試設備。然而，在大的電路板上，邊界掃描鏈路很長，電路板設計人員面臨著多種挑戰(zhàn)，諸如故障檢測和隔離、測試時間、物理布線，同時還要管理偏移，電壓轉(zhuǎn)換和滿足各種特殊需要。傳統(tǒng)上使用ASSP來應對這些挑戰(zhàn)，然而基于ASSP的解決方案更為昂貴，有固定的電平和一些
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